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1. (WO2004004122) スタティック型フリップフロップ回路
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2004/004122    国際出願番号:    PCT/JP2003/007963
国際公開日: 08.01.2004 国際出願日: 24.06.2003
予備審査請求日:    24.06.2003    
IPC:
H03K 3/012 (2006.01), H03K 3/289 (2006.01)
出願人: NEC CORPORATION [JP/JP]; 7-1, Shiba 5-chome, Minato-ku, Tokyo 108-8001 (JP) (米国を除く全ての指定国).
SUZUKI, Yasuyuki [JP/JP]; (JP) (米国のみ).
WADA, Shigeki [JP/JP]; (JP) (米国のみ).
AMAMIYA, Yasushi [JP/JP]; (JP) (米国のみ)
発明者: SUZUKI, Yasuyuki; (JP).
WADA, Shigeki; (JP).
AMAMIYA, Yasushi; (JP)
代理人: MIYAZAKI, Teruo; 8th Floor, 16th Kowa Bldg., 9-20, Akasaka 1-chome, Minato-ku, Tokyo 107-0052 (JP)
優先権情報:
2002-192068 01.07.2002 JP
発明の名称: (EN) STATIC FLIP-FLOP CIRCUIT
(FR) CIRCUIT A BASCULE STATIQUE
(JA) スタティック型フリップフロップ回路
要約: front page image
(EN)In a master circuit (1) and a slave circuit (2), the size of the transistor constituting a data holding differential pair is set smaller than the size of the transistor constituting a data read out differential pair. Furthermore, a flip-flop circuit is operated in such a high operation speed range that the current of the data holding differential pair becomes smaller than the current of the data read out differential pair and the current of the data holding differential pair becomes not greater than the allowable current of the transistor constituting the data holding differential pair.
(FR)Dans un circuit maître (1) et un circuit esclave (2), la taille du transistor formant une paire différentielle de conservation de données est réglée inférieure à la taille du transistor formant une paire différentielle d'extraction de données. De plus, un circuit à bascule est mis en fonction dans une telle plage de vitesse de fonctionnement élevée que le courant de la paire différentielle de conservation de données devient inférieur au courant de la paire différentielle d'extraction de données et que le courant de la paire différentielle de conservation de données ne dépasse pas le courant admissible du transistor formant la paire différentielle de conservation de données.
(JA)マスター回路1およびスレーブ回路2は、データ保持用差動対を構成するトランジスタのサイズがデータ読み出し用差動対を構成するトランジスタよりも小さく設定されている。さらに、データ保持用差動対の電流がデータ読み出し用差動対の電流よりも小さくなり、かつデータ保持用差動対の電流が当該データ保持用差動対を構成するトランジスタの許容電流以下となるような高速動作速度領域で、フリップフロップ回路を動作させる。
指定国: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)