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1. WO2020114337 - PROCÉDÉ ET DISPOSITIF DE CODAGE ET DE DÉCODAGE DE CODE LDPC

Numéro de publication WO/2020/114337
Date de publication 11.06.2020
N° de la demande internationale PCT/CN2019/122269
Date du dépôt international 30.11.2019
CIB
H04L 1/00 2006.01
HÉLECTRICITÉ
04TECHNIQUE DE LA COMMUNICATION ÉLECTRIQUE
LTRANSMISSION D'INFORMATION NUMÉRIQUE, p.ex. COMMUNICATION TÉLÉGRAPHIQUE
1Dispositions pour détecter ou empêcher les erreurs dans l'information reçue
Déposants
  • 华为技术有限公司 HUAWEI TECHNOLOGIES CO., LTD. [CN]/[CN]
Inventeurs
  • 蒙托里西·基多 MONTORSI, Guido
  • 贝勒迪多·塞吉奥 BENEDETTO, Sergio
  • 林伟 LIN, Wei
  • 辛岩 XIN, Yan
Données relatives à la priorité
201811473706.404.12.2018CN
Langue de publication chinois (ZH)
Langue de dépôt chinois (ZH)
États désignés
Titre
(EN) LDPC CODE ENCODING AND DECODING METHOD AND RELATED DEVICE
(FR) PROCÉDÉ ET DISPOSITIF DE CODAGE ET DE DÉCODAGE DE CODE LDPC
(ZH) 低密度奇偶校验LDPC码的编译码方法、相关装置
Abrégé
(EN)
The present application provides a method and device for encoding and decoding a low density parity check code (LDPC) code. The solution of the present application is based on a parity check H matrix; LDPC encoding is performed on 8064 information bits, and the encoded obtained LDPC codes have code rates of R = 1/2, 5/8, 3/4, 13/16, and 7/8, the parity check H matrix being a (n+s-k)×(n+s) parity check matrix; the H matrix is divided into sub-square matrices of size Z×Z, the value of Z being 64 or 42; the sub-square matrix is a cyclic shift or empty matrix of the identity matrix, and s is the number of columns to be shortened corresponding to the H matrix, and is a positive integer multiple of Z.
(FR)
La présente invention concerne un procédé et un dispositif de codage et de décodage d'un code de code de contrôle de parité de faible densité (LDPC). La solution selon la présente invention est basée sur une matrice H de vérification de parité ; un codage LDPC est effectué sur 8064 bits d'information, et les codes LDPC obtenus codés ont des débits de code de R = 1/2, 5/8, 3/4, 13/16, et 7/8, la matrice H de vérification de parité étant une matrice de vérification de parité (n+s-k)×(n+s) ; la matrice H est divisée en matrices sous-carrées de taille Z×Z, la valeur de Z étant de 64 ou 42 ; la matrice sous-carrée est un décalage cyclique ou une matrice vide de la matrice d'identité, et s est le nombre de colonnes à raccourcir correspondant à la matrice H, et est un multiple entier positif de Z.
(ZH)
本申请提供了一种奇偶校验LDPC码的编译码方法和装置。本申请的方案根据奇偶校验H矩阵,对8064个信息比特进行LDPC编码,编码得到码率分别为R=1/2,5/8,3/4,13/16,7/8的LDPC码,其中奇偶校验H矩阵为(n+s-k)×(n+s)的奇偶校验矩阵,H矩阵被划分为大小为Z×Z维的子方阵,所述Z取值为64或42,子方阵为单位矩阵的循环移位或空矩阵,s为待缩短比特与所述H矩阵所对应的列数,且为Z的正整数倍。
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