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1. (WO2019067052) CALCULS DE RÉFÉRENCE DE TENSION POUR ÉGALISEURS DE RÉTROACTION DE DÉCISION DE MÉMOIRE
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N° de publication : WO/2019/067052 N° de la demande internationale : PCT/US2018/039816
Date de publication : 04.04.2019 Date de dépôt international : 27.06.2018
CIB :
G11C 7/10 (2006.01)
G PHYSIQUE
11
ENREGISTREMENT DE L'INFORMATION
C
MÉMOIRES STATIQUES
7
Dispositions pour écrire une information ou pour lire une information dans une mémoire numérique
10
Dispositions d'interface d'entrée/sortie (E/S, I/O) de données, p.ex. circuits de commande E/S de données, mémoires tampon de données E/S
Déposants :
MICRON TECHNOLOGY, INC [US/US]; 8000 South Federal Way Boise, Idaho 83707, US
Inventeurs :
TAYLOR, Jennifer E.; US
SREERAMANENI, Raghukiran; US
Mandataire :
MANWARE, Robert A.; US
FLETCHER, Michael G.; US
YODER, Patrick S.; US
POWELL, W. Allen; US
RARIDEN, John M.; US
SWANSON, Tait R.; US
BAKKER, Jila; US
SINCLAIR, JR.,, Steven J.; US
OSTERHAUS, Matthew G.; US
DOOLEY, Matthew C.; US
HENWOOD, Matthew C.; US
KANTOR, Andrew L.; US
WIMMER, Lance G.; US
BELLAH, Sean J.; US
THOMAS, Jim; US
CORLEY, David; US
Données relatives à la priorité :
15/716,13226.09.2017US
Titre (EN) VOLTAGE REFERENCE COMPUTATIONS FOR MEMORY DECISION FEEDBACK EQUALIZERS
(FR) CALCULS DE RÉFÉRENCE DE TENSION POUR ÉGALISEURS DE RÉTROACTION DE DÉCISION DE MÉMOIRE
Abrégé :
(EN) A device (10) includes a combinational circuit configured to create a one or more distortion correction factors used offset inter-symbol interference from a data stream on a distorted bit. The device (10) also includes a selection circuit (368) coupled to the combinational circuit. The selection circuit (368) includes a feedback pin (492) configured to receive a control signal and an output, wherein the selection circuit (368) is configured to select a first distortion correction factor of the one or more distortion correction factors based upon the control signal and transmit the first distortion correction factor from the output.
(FR) L'invention concerne un dispositif (10) qui comprend un circuit combinatoire configuré pour créer un ou plusieurs facteurs de correction de distorsion utilisés pour compenser un brouillage inter-symboles à partir d'un flux de données sur un bit distordu. Le dispositif (10) comprend également un circuit de sélection (368) couplé au circuit combinatoire. Le circuit de sélection (368) comprend une broche de rétroaction (492) configurée pour recevoir un signal de commande et une sortie, le circuit de sélection (368) est configuré pour sélectionner un premier facteur de correction de distorsion du ou des facteurs de correction de distorsion sur la base du signal de commande et transmettre le premier facteur de correction de distorsion à partir de la sortie.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
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Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)