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1. (WO2019033340) TRANSLATEUR DE NIVEAU APTE À DÉLIVRER DES TENSIONS POSITIVES ET NÉGATIVES
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N° de publication : WO/2019/033340 N° de la demande internationale : PCT/CN2017/097857
Date de publication : 21.02.2019 Date de dépôt international : 17.08.2017
CIB :
H03K 19/0175 (2006.01) ,H03K 19/0185 (2006.01)
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
K
TECHNIQUE DE L'IMPULSION
19
Circuits logiques, c. à d. ayant au moins deux entrées agissant sur une sortie; Circuits d'inversion
0175
Dispositions pour le couplage; Dispositions pour l'interface
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
K
TECHNIQUE DE L'IMPULSION
19
Circuits logiques, c. à d. ayant au moins deux entrées agissant sur une sortie; Circuits d'inversion
0175
Dispositions pour le couplage; Dispositions pour l'interface
0185
utilisant uniquement des transistors à effet de champ
Déposants :
深圳市汇顶科技股份有限公司 SHENZHEN GOODIX TECHNOLOGY CO., LTD. [CN/CN]; 中国广东省深圳市 福田保税区腾飞工业大厦B座13层 Floor 13, Phase B Tengfei Industrial Building Futian Free Trade Zone Shenzhen, Guangdong 518045, CN
Inventeurs :
黄慕理 HUANG, Muli; CN
Mandataire :
上海晨皓知识产权代理事务所(普通合伙) SHANGHAI CHENHAO INTELLECTUAL PROPERTY LAW FIRM GENERAL PARTNERSHIP; 中国上海市 黄浦区制造局路787号二幢202B室 Room 202B, Building 2 787 Zhizaoju Road, Huangpu District Shanghai 200011, CN
Données relatives à la priorité :
Titre (EN) LEVEL TRANSLATOR CAPABLE OF OUTPUTTING POSITIVE AND NEGATIVE VOLTAGES
(FR) TRANSLATEUR DE NIVEAU APTE À DÉLIVRER DES TENSIONS POSITIVES ET NÉGATIVES
(ZH) 一种可输出正负电压的电平转换器
Abrégé :
(EN) A level translator (10) comprises a first P-type transistor (MP2); a second P-type transistor (MP1); a third P-type transistor (MP3), coupled to the second P-type transistor (MP1); a fourth P-type transistor (MP4), coupled to the first P-type transistor (MP2); a first N-type transistor (MN1), coupled to the third P-type transistor (MP3); a second N-type transistor (MN2), coupled to the fourth P-type transistor (MP4); a third N-type transistor (MN3), coupled to the first N-type transistor (MN1); a fourth N-type transistor (MN4), coupled to the second N-type transistor (MN2); and an inverter (INN), coupled between the third N-type transistor and the fourth N-type transistor, and an input end of the inverter receiving an input signal (LS_IN) of the level translator.
(FR) Translateur de niveau (10), comprenant un premier transistor de type P (MP2) ; un deuxième transistor de type P (MP1) ; un troisième transistor de type P (MP3), couplé au deuxième transistor de type P (MP1) ; un quatrième transistor de type P (MP4), couplé au premier transistor de type P (MP2) ; un premier transistor de type N (MN1), couplé au troisième transistor de type P (MP3) ; un deuxième transistor de type N (MN2), couplé au quatrième transistor de type P (MP4) ; un troisième transistor de type N (MN3), couplé au premier transistor de type N (MN1) ; un quatrième transistor de type N (MN4), couplé au deuxième transistor de type N (MN2) ; et un inverseur (INN), couplé entre le troisième transistor de type N et le quatrième transistor de type N, et une extrémité d’entrée de l’inverseur recevant un signal d’entrée (LS_IN) du translateur de niveau.
(ZH) 一种电平转换器(10)包括第一P型晶体管(MP2);第二P型晶体管(MP1);第三P型晶体管(MP3),耦接于第二P型晶体管(MP1);第四P型晶体管(MP4),耦接于第一P型晶体管(MP2);第一N型晶体管(MN1),耦接于第三P型晶体管(MP3);第二N型晶体管(MN2),耦接于第四P型晶体管(MP4);第三N型晶体管(MN3),耦接于第一N型晶体管(MN1);第四N型晶体管(MN4),耦接于所述第二N型晶体管(MN2);以及反向器(INN),耦接于第三N型晶体管与第四N型晶体管之间,反向器的输入端接收电平转换器的输入信号(LS_IN)。
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Langue de publication : chinois (ZH)
Langue de dépôt : chinois (ZH)