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1. (WO2019032151) COMPTEURS D'ADRESSES PARTAGÉS POUR DE MULTIPLES MODES DE FONCTIONNEMENT DANS UN DISPOSITIF DE MÉMOIRE
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N° de publication : WO/2019/032151 N° de la demande internationale : PCT/US2018/027820
Date de publication : 14.02.2019 Date de dépôt international : 16.04.2018
CIB :
G11C 8/04 (2006.01) ,G11C 8/12 (2006.01) ,G11C 7/10 (2006.01)
G PHYSIQUE
11
ENREGISTREMENT DE L'INFORMATION
C
MÉMOIRES STATIQUES
8
Dispositions pour sélectionner une adresse dans une mémoire numérique
04
utilisant un dispositif d'adressage séquentiel, p.ex. registre à décalage, compteur
G PHYSIQUE
11
ENREGISTREMENT DE L'INFORMATION
C
MÉMOIRES STATIQUES
8
Dispositions pour sélectionner une adresse dans une mémoire numérique
12
Circuits de sélection de groupe, p.ex. pour la sélection d'un bloc de mémoire, la sélection d'une puce, la sélection d'un réseau de cellules
G PHYSIQUE
11
ENREGISTREMENT DE L'INFORMATION
C
MÉMOIRES STATIQUES
7
Dispositions pour écrire une information ou pour lire une information dans une mémoire numérique
10
Dispositions d'interface d'entrée/sortie (E/S, I/O) de données, p.ex. circuits de commande E/S de données, mémoires tampon de données E/S
Déposants :
MICRON TECHNOLOGY, INC [US/US]; 8000 South Federal Way Boise, Idaho 83707, US
Inventeurs :
BROWN, David R.; US
Mandataire :
MANWARE, Robert A.; US
FLETCHER, Michael G.; US
YODER, Patrick S.; US
POWELL, W. Allen; US
RARIDEN, John M.; US
SWANSON, Tait R.; US
BAKKER, Jila; US
SINCLAIR, JR., Steven J.; US
OSTERHAUS, Matthew G.; US
DOOLEY, Matthew C.; US
HENWOOD, Matthew C.; US
KANTOR, Andrew L.; US
WIMMER, Lance G.; US
BELLAH, Sean J.; US
THOMAS, Jim; US
CORLEY, David; US
Données relatives à la priorité :
15/674,17810.08.2017US
Titre (EN) SHARED ADDRESS COUNTERS FOR MULTIPLE MODES OF OPERATION IN A MEMORY DEVICE
(FR) COMPTEURS D'ADRESSES PARTAGÉS POUR DE MULTIPLES MODES DE FONCTIONNEMENT DANS UN DISPOSITIF DE MÉMOIRE
Abrégé :
(EN) As described above, certain modes of operation, such as the Fast Zero mode and the ECS mode, may facilitate sequential access to individual cells of a memory array. To facilitate this functionality, a command controller may be provided, including one or more individual controllers to control the address sequencing when a particular mode entry command (e.g., Fast Zero or ECS) is received. In order to generate internal addresses to be accessed sequentially, one or more counters may also be provided. Advantageously, the counters may be shared such that they can be used in any mode of operation that may require address sequencing of all or large portions of the memory array, such as the Fast Zero mode or the ECS mode.
(FR) Comme mentionné précédemment, l'invention concerne certains modes de fonctionnement, tels que le mode zéro rapide et le mode ECS, qui peuvent faciliter un accès séquentiel à des cellules individuelles d'un réseau de mémoire. Pour faciliter cette fonctionnalité, un dispositif de commande peut être fourni, comprenant un ou plusieurs dispositifs de commande individuels pour commander le séquençage d'adresse lorsqu'une commande d'entrée de mode particulier (par exemple, zéro rapide ou ECS) est reçue. Afin de générer des adresses internes devant faire l'objet d'un accès séquentiel, un ou plusieurs compteurs peuvent également être prévus. De manière avantageuse, les compteurs peuvent être partagés de façon à ce qu'ils puissent être utilisés dans n'importe quel mode de fonctionnement pouvant nécessiter un séquençage d'adresse de la totalité ou d'importantes parties du réseau de mémoire, tels que le mode zéro rapide ou le mode ECS.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)