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1. (WO2019009980) TECHNOLOGIES DE PROGRAMMATION D'APPLICATION DE RÉSEAU AVEC DES RÉSEAUX PRÉDIFFUSÉS PROGRAMMABLES PAR L'UTILISATEUR
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N° de publication : WO/2019/009980 N° de la demande internationale : PCT/US2018/036449
Date de publication : 10.01.2019 Date de dépôt international : 07.06.2018
CIB :
G06F 13/10 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
13
Interconnexion ou transfert d'information ou d'autres signaux entre mémoires, dispositifs d'entrée/sortie ou unités de traitement
10
Commande par programme pour dispositifs périphériques
Déposants :
INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, CA 95054, US
Inventeurs :
DALY, Daniel, P.; US
WILLIS, Thomas, E.; US
WANG, Pat; US
ANAND, Vishal; US
NGUYEN, Hung; US
APTE, Varsha; US
Mandataire :
KELLETT, Glen, M.; US
Données relatives à la priorité :
15/644,15007.07.2017US
Titre (EN) TECHNOLOGIES FOR NETWORK APPLICATION PROGRAMMING WITH FIELD-PROGRAMMABLE GATE ARRAYS
(FR) TECHNOLOGIES DE PROGRAMMATION D'APPLICATION DE RÉSEAU AVEC DES RÉSEAUX PRÉDIFFUSÉS PROGRAMMABLES PAR L'UTILISATEUR
Abrégé :
(EN) Technologies for network application programming include a computing device that analyzes a network application source program. The source program includes a declarative description of a network application in a domain-specific language, such as P4. The computing device translates the declarative description of the network application into a register-transfer level (RTL) description, and then compiles the RTL description into a bitstream definition that is targeted to an FPGA. For example, the computing device may generate a parse graph based on the network application source program, and then generate an RTL TCAM-SRAM structure for each node of the parse graph. The computing device may optimize the RTL description, for example by simplifying RTL structures or removing unused logic. The computing device may program an FPGA with the bitstream definition. Other embodiments are described and claimed.
(FR) Selon l'invention, des technologies de programmation d'application de réseau contiennent un dispositif informatique qui analyse un programme source d'application de réseau. Le programme source contient une description déclarative d'une application de réseau dans un langage spécifique au domaine, tel que P4. Le dispositif informatique traduit la description déclarative de l'application de réseau en une description de niveau de transfert de registre (RTL), puis compile la description RTL en une définition de train de bits qui est envoyée à un FPGA. Par exemple, le dispositif informatique peut produire un graphe d'analyse en fonction du programme source d'application de réseau, puis produire une structure TCAM-SRAM RTL pour chaque nœud du graphe d'analyse. Le dispositif informatique peut optimiser la description RTL, par exemple en simplifiant les structures RTL ou en éliminant la logique non utilisée. Le dispositif informatique peut programmer un FPGA avec la définition de train de bits. L'invention concerne également d'autres modes de réalisation.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
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Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)