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1. (WO2018200578) RÉTENTION D'ÉTAT STRUCTURÉ
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N° de publication : WO/2018/200578 N° de la demande internationale : PCT/US2018/029211
Date de publication : 01.11.2018 Date de dépôt international : 24.04.2018
CIB :
G06F 1/32 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
1
Détails non couverts par les groupes G06F3/-G06F13/89
26
Alimentation en énergie électrique, p.ex. régulation à cet effet
32
Moyens destinés à économiser de l'énergie
Déposants :
APPLE INC. [US/US]; One Apple Park Way Cupertino, California 95014, US
Inventeurs :
SEMERIA, Bernard Joseph; US
MYLIUS, John H.; US
KANAPATHIPILLAI, Pradeep; US
RUSSO, Richard F.; US
WEN, Shih-Chieh; US
LARSON, Richard H.; US
Mandataire :
RANKIN, Rory D.; US
Données relatives à la priorité :
15/496,29025.04.2017US
Titre (EN) ARCHITECTED STATE RETENTION
(FR) RÉTENTION D'ÉTAT STRUCTURÉ
Abrégé :
(EN) Systems, apparatuses, and methods for retaining architected state for relatively frequent switching between sleep and active operating states are described. A processor receives an indication to transition from an active state to a sleep state. The processor stores a copy of a first subset of the architected state information in on-die storage elements capable of retaining storage after power is turned off. The processor supports programmable input/output (PIO) access of particular stored information during the sleep state. When a wakeup event is detected, circuitry within the processor is powered up again. A boot sequence and recovery of architected state from off-chip memory are not performed. Rather than fetch from a memory location pointed to by a reset base address register, the processor instead fetches an instruction from a memory location pointed to by a restored program counter of the retained subset of the architected state information.
(FR) L'invention concerne des systèmes, des appareils et des procédés pour retenir un état structuré pour une commutation relativement fréquente entre des états opérationnel en veille et actif. Un processeur reçoit une indication pour passer d'un état actif à un état de veille. Le processeur stocke une copie d'un premier sous-ensemble des informations d'état structuré dans des éléments de stockage intégrés aptes à maintenir le stockage après la déconnexion de la source d'énergie. Le processeur prend en charge l'accès d'entrée/sortie programmable (PIO) d'informations stockées particulières pendant l'état de veille. Lorsqu'un événement de réveil est détecté, des circuits à l'intérieur du processeur sont de nouveau alimentés. Une séquence de démarrage et une récupération de l'état structuré à partir d'une mémoire non intégrée ne sont pas effectuées. Plutôt que d'extraire depuis un emplacement de mémoire pointé par un registre d'adresse de base de réinitialisation, le processeur extrait plutôt une instruction d'un emplacement de mémoire pointé par un compteur de programme restauré du sous-ensemble retenu des informations d'état structuré.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
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Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)