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1. (WO2018184602) PROCÉDÉ DE GRAVURE D'UN OU PLUSIEURS ÉLÉMENTS PARMI UN MÉTAL MIXTE ET UNE COUCHE DIÉLECTRIQUE D'UN DISPOSITIF À SEMI-CONDUCTEUR
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N° de publication : WO/2018/184602 N° de la demande internationale : PCT/CZ2017/000021
Date de publication : 11.10.2018 Date de dépôt international : 04.04.2017
CIB :
H01L 21/311 (2006.01) ,H01L 21/3213 (2006.01) ,H01L 21/306 (2006.01)
H ÉLECTRICITÉ
01
ÉLÉMENTS ÉLECTRIQUES FONDAMENTAUX
L
DISPOSITIFS À SEMI-CONDUCTEURS; DISPOSITIFS ÉLECTRIQUES À L'ÉTAT SOLIDE NON PRÉVUS AILLEURS
21
Procédés ou appareils spécialement adaptés à la fabrication ou au traitement de dispositifs à semi-conducteurs ou de dispositifs à l'état solide, ou bien de leurs parties constitutives
02
Fabrication ou traitement des dispositifs à semi-conducteurs ou de leurs parties constitutives
04
les dispositifs présentant au moins une barrière de potentiel ou une barrière de surface, p.ex. une jonction PN, une région d'appauvrissement, ou une région de concentration de porteurs de charges
18
les dispositifs ayant des corps semi-conducteurs comprenant des éléments du quatrième groupe de la Classification Périodique, ou des composés AIIIBV, avec ou sans impuretés, p.ex. des matériaux de dopage
30
Traitement des corps semi-conducteurs en utilisant des procédés ou des appareils non couverts par les groupes H01L21/20-H01L21/26162
31
pour former des couches isolantes en surface, p.ex. pour masquer ou en utilisant des techniques photolithographiques; Post-traitement de ces couches; Emploi de matériaux spécifiés pour ces couches
3105
Post-traitement
311
Gravure des couches isolantes
H ÉLECTRICITÉ
01
ÉLÉMENTS ÉLECTRIQUES FONDAMENTAUX
L
DISPOSITIFS À SEMI-CONDUCTEURS; DISPOSITIFS ÉLECTRIQUES À L'ÉTAT SOLIDE NON PRÉVUS AILLEURS
21
Procédés ou appareils spécialement adaptés à la fabrication ou au traitement de dispositifs à semi-conducteurs ou de dispositifs à l'état solide, ou bien de leurs parties constitutives
02
Fabrication ou traitement des dispositifs à semi-conducteurs ou de leurs parties constitutives
04
les dispositifs présentant au moins une barrière de potentiel ou une barrière de surface, p.ex. une jonction PN, une région d'appauvrissement, ou une région de concentration de porteurs de charges
18
les dispositifs ayant des corps semi-conducteurs comprenant des éléments du quatrième groupe de la Classification Périodique, ou des composés AIIIBV, avec ou sans impuretés, p.ex. des matériaux de dopage
30
Traitement des corps semi-conducteurs en utilisant des procédés ou des appareils non couverts par les groupes H01L21/20-H01L21/26162
31
pour former des couches isolantes en surface, p.ex. pour masquer ou en utilisant des techniques photolithographiques; Post-traitement de ces couches; Emploi de matériaux spécifiés pour ces couches
3205
Dépôt de couches non isolantes, p.ex. conductrices ou résistives, sur des couches isolantes; Post-traitement de ces couches
321
Post-traitement
3213
Gravure physique ou chimique des couches, p.ex. pour produire une couche avec une configuration donnée à partir d'une couche étendue déposée au préalable
H ÉLECTRICITÉ
01
ÉLÉMENTS ÉLECTRIQUES FONDAMENTAUX
L
DISPOSITIFS À SEMI-CONDUCTEURS; DISPOSITIFS ÉLECTRIQUES À L'ÉTAT SOLIDE NON PRÉVUS AILLEURS
21
Procédés ou appareils spécialement adaptés à la fabrication ou au traitement de dispositifs à semi-conducteurs ou de dispositifs à l'état solide, ou bien de leurs parties constitutives
02
Fabrication ou traitement des dispositifs à semi-conducteurs ou de leurs parties constitutives
04
les dispositifs présentant au moins une barrière de potentiel ou une barrière de surface, p.ex. une jonction PN, une région d'appauvrissement, ou une région de concentration de porteurs de charges
18
les dispositifs ayant des corps semi-conducteurs comprenant des éléments du quatrième groupe de la Classification Périodique, ou des composés AIIIBV, avec ou sans impuretés, p.ex. des matériaux de dopage
30
Traitement des corps semi-conducteurs en utilisant des procédés ou des appareils non couverts par les groupes H01L21/20-H01L21/26162
302
pour changer leurs caractéristiques physiques de surface ou leur forme, p.ex. gravure, polissage, découpage
306
Traitement chimique ou électrique, p.ex. gravure électrolytique
Déposants : TESCAN BRNO, S.R.O.[CZ/CZ]; Libusina trida 816/1 Brno 62300, CZ
ORSAY PHYSICS[FR/FR]; FR
Inventeurs : GOUPIL, Gregory; FR
SHARANG; IN
BRULIK, Jan; CZ
Mandataire : JORDAN, Michal; Koliste 1965/13a Brno 60200, CZ
Données relatives à la priorité :
Titre (EN) A METHOD OF ETCHING ONE OR MORE OF MIXED METAL AND DIELECTRIC LAYER OF A SEMICONDUCTOR DEVICE
(FR) PROCÉDÉ DE GRAVURE D'UN OU PLUSIEURS ÉLÉMENTS PARMI UN MÉTAL MIXTE ET UNE COUCHE DIÉLECTRIQUE D'UN DISPOSITIF À SEMI-CONDUCTEUR
Abrégé :
(EN) The invention is a method for performing a planar and cross-sectional etching of semiconductor devices made up of multiple layers of dissimilar materials like metals and dielectrics. The method results in the removal of multiple layers with the aim of either exposing a single layer of interest or cross-sectioning several layers to perform various applications including but not limited to, nanoprobing, circuit edit and failure analysis. The method comprises directing an ion beam toward a defined area on the semiconductor device in the presence of an etching agent, thereby removing at least a portion of the mixed metal and dielectric layer and producing a recess with at least one substantially smooth and planar surface in the milled area. The used etching agent comprises oxidizing and reducing elements in a ratio optimized such that the quantity of oxidizing elements is one element more than the quantity of reducing elements.
(FR) L'invention concerne un procédé de réalisation d'une gravure plane et en coupe transversale de dispositifs à semi-conducteurs constitués de multiples couches de matériaux dissemblables tels que des métaux et des diélectriques. Le procédé conduit à l'élimination de multiples couches dans le but d'exposer une seule couche d'intérêt ou de sectionner transversalement plusieurs couches pour effectuer diverses applications comprenant, mais sans y être limitées, le nano-sondage, le montage de circuit et l'analyse de défaillance. Le procédé consiste à diriger un faisceau d'ions vers une zone définie sur le dispositif à semi-conducteur en présence d'un agent de gravure, ce qui permet d'éliminer au moins une partie du métal mixte et de la couche diélectrique et de produire un évidement avec au moins une surface sensiblement lisse et plane dans la zone broyée. L'agent de gravure utilisé comprend des éléments d'oxydation et de réduction dans un rapport optimisé de telle sorte que la quantité d'éléments oxydants est un élément supérieur à la quantité d'éléments de réduction.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)