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1. (WO2018164828) GÉNÉRATEUR D'HORLOGE FRACTIONNAIRE DOTÉ DE COMMANDE DE RAMPE COMPRENANT UN INTERVALLE DE TEMPS FIXE ET DES ÉTAPES DE CHANGEMENT APPROXIMATIF/PRÉCIS DE FRÉQUENCE
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N° de publication : WO/2018/164828 N° de la demande internationale : PCT/US2018/018623
Date de publication : 13.09.2018 Date de dépôt international : 19.02.2018
CIB :
H03K 3/017 (2006.01) ,H03L 7/085 (2006.01)
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
K
TECHNIQUE DE L'IMPULSION
3
Circuits pour produire des impulsions électriques; Circuits monostables, bistables ou multistables
01
Détails
017
Réglage de la largeur ou du rapport durée période des impulsions
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
L
COMMANDE AUTOMATIQUE, DÉMARRAGE, SYNCHRONISATION OU STABILISATION DES GÉNÉRATEURS D'OSCILLATIONS OU D'IMPULSIONS ÉLECTRONIQUES
7
Commande automatique de fréquence ou de phase; Synchronisation
06
utilisant un signal de référence qui est appliqué à une boucle verrouillée en fréquence ou en phase
08
Détails de la boucle verrouillée en phase
085
concernant principalement l'agencement de détection de phase ou de fréquence y compris le filtrage ou l'amplification de son signal de sortie
Déposants :
QUALCOMM INCORPORATED [US/US]; Attn: International IP Administration 5775 Morehouse Drive San Diego, California 92121-1714, US
Inventeurs :
BOWLES, Kevin; US
PAL, Dipti Ranjan; US
Mandataire :
FOUNTAIN, George; US
Données relatives à la priorité :
15/453,71208.03.2017US
Titre (EN) FRACTIONAL CLOCK GENERATOR WITH RAMP CONTROL INCLUDING FIXED TIME INTERVAL AND COARSE/FINE FREQUENCY CHANGE STEPS
(FR) GÉNÉRATEUR D'HORLOGE FRACTIONNAIRE DOTÉ DE COMMANDE DE RAMPE COMPRENANT UN INTERVALLE DE TEMPS FIXE ET DES ÉTAPES DE CHANGEMENT APPROXIMATIF/PRÉCIS DE FRÉQUENCE
Abrégé :
(EN) A clock signal generator including a fractional clock divider and a frequency ramp control circuit. The fractional clock divider is configured to generate an output clock signal with a frequency being a divider ratio multiplied by a frequency of an input clock signal. The frequency ramp control circuit is configured to provide the fractional clock divider a set of divider ratios so that the frequency of the output clock signal is ramped in steps from a current frequency to a target frequency. The frequency ramp control circuit is configured to produce frequency change steps each having substantially the same duration. The frequency ramp control circuit is also configured to provide the set of divider ratios such as a first portion of the frequency ramp is performed using coarse frequency changes and a second portion of the ramp is performed using at least one fine frequency change.
(FR) L'invention concerne un générateur de signal d'horloge comprenant un diviseur d'horloge fractionnaire et un circuit de commande de rampe de fréquence. Le diviseur d'horloge fractionnaire est configuré afin de générer un signal d'horloge de sortie ayant une fréquence qui est un rapport de division multiplié par une fréquence d'un signal d'horloge d'entrée. Le circuit de commande de rampe de fréquence est configuré afin de fournir au diviseur d'horloge fractionnaire un ensemble de rapports de division de sorte que la fréquence du signal d'horloge de sortie soit augmentée par étapes à partir d'une fréquence actuelle vers une fréquence cible. Le circuit de commande de rampe de fréquence est configuré afin de produire des étapes de changement de fréquence ayant chacune sensiblement la même durée. Le circuit de commande de rampe de fréquence est également configuré pour fournir l'ensemble des rapports de division de sorte qu'une première partie de rampe de fréquence soit réalisée au moyen de changements approximatifs de la fréquence et qu'une seconde partie de rampe soit réalisée au moyen d'au moins un changement précis de la fréquence.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)