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1. (WO2018161561) REGISTRE À DÉCALAGE, SON PROCÉDÉ DE COMMANDE, CIRCUIT DE COMMANDE DE GRILLE ET DISPOSITIF D’AFFICHAGE
Dernières données bibliographiques dont dispose le Bureau international    Formuler une observation

N° de publication : WO/2018/161561 N° de la demande internationale : PCT/CN2017/105496
Date de publication : 13.09.2018 Date de dépôt international : 10.10.2017
CIB :
G09G 3/20 (2006.01) ,G11C 19/28 (2006.01)
G PHYSIQUE
09
ENSEIGNEMENT; CRYPTOGRAPHIE; PRÉSENTATION; PUBLICITÉ; SCEAUX
G
DISPOSITIONS OU CIRCUITS POUR LA COMMANDE DE L'AFFICHAGE UTILISANT DES MOYENS STATIQUES POUR PRÉSENTER UNE INFORMATION VARIABLE
3
Dispositions ou circuits de commande présentant un intérêt uniquement pour l'affichage utilisant des moyens de visualisation autres que les tubes à rayons cathodiques
20
pour la présentation d'un ensemble de plusieurs caractères, p.ex. d'une page, en composant l'ensemble par combinaison d'éléments individuels disposés en matrice
G PHYSIQUE
11
ENREGISTREMENT DE L'INFORMATION
C
MÉMOIRES STATIQUES
19
Mémoires numériques dans lesquelles l'information est déplacée par échelons, p.ex. registres à décalage
28
utilisant des éléments semi-conducteurs
Déposants : BOE TECHNOLOGY GROUP CO. , LTD.[CN/CN]; No. 10 Jiuxianqiao Rd. , Chaoyang District Beijing 100015, CN
HEFEI XINSHENG OPTOELECTRONICS TECHNOLOGY CO. , LTD.[CN/CN]; Xinzhan Industrial Park Hefei, Anhui 230012, CN
Inventeurs : ZHANG, Miao; CN
CHEN, Mo; CN
SUN, Jing; CN
FU, Wuxia; CN
Mandataire : TEE&HOWE INTELLECTUAL PROPERTY ATTORNEYS; CHEN, Yuan 10th Floor, Tower D, Minsheng Financial Center 28 Jianguomennei Avenue, Dongcheng District Beijing 100005, CN
Données relatives à la priorité :
201710137323.909.03.2017CN
Titre (EN) SHIFT REGISTER, DRIVING METHOD THEREOF, GATE DRIVING CIRCUIT AND DISPLAY DEVICE
(FR) REGISTRE À DÉCALAGE, SON PROCÉDÉ DE COMMANDE, CIRCUIT DE COMMANDE DE GRILLE ET DISPOSITIF D’AFFICHAGE
Abrégé :
(EN) A shift register (200) includes a first input circuit (10), a second input circuit (20), and a pull-up transistor (M3). The first input circuit (10) is coupled to a first input terminal (IN_1) and a first pull-up node (PU_1), and configured to electrically connect the first input terminal (IN_1) to the first pull-up node (PU_1) when the first input terminal (IN_1) receives an active signal. The second input circuit (20) is coupled to a second input terminal (IN_2) and a second pull-up node (PU_2), and configured to electrically connect the second input terminal (IN_2) to the second pull-up node (PU_2) when the second input terminal (IN_2) receives an active signal. The pull-up transistor (M3) includes a first gate electrode coupled to the first pull-up node (PU_1) and a second gate electrode coupled to the second pull-up node (PU_2).
(FR) Selon l’invention, un registre à décalage (200) comporte un premier circuit d’entrée (10), un second circuit d’entrée (20) et un transistor de tirage vers le haut (M3). Le premier circuit d’entrée (10) est couplé à une première borne d’entrée (IN_1) et à un premier nœud de tirage vers le haut (PU_1), et est configuré pour connecter électriquement la première borne d’entrée (IN_1) au premier nœud de tirage vers le haut (PU_1) lorsque la première borne d’entrée (IN_1) reçoit un signal actif. Le second circuit d’entrée (20) est couplé à une seconde borne d’entrée (IN_2) et à un second nœud de tirage vers le haut (PU_2), et est configuré pour connecter électriquement la seconde borne d’entrée (IN_2) au second nœud de tirage vers le haut (PU_2) lorsque la seconde borne d’entrée (IN_2) reçoit un signal actif. Le transistor de tirage vers le haut (M3) comporte une première électrode de grille couplée au premier nœud de tirage vers le haut (PU_1) et une seconde électrode de grille couplée au second nœud de tirage vers le haut (PU_2).
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Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)