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1. (WO2018141197) CONVERTISSEUR ANALOGIQUE/NUMÉRIQUE À REGISTRE D'APPROXIMATIONS SUCCESSIVES ASYNCHRONE À BOUCLE DE COMMANDE DE RÉTROACTION DE VITESSE DE CONVERSION
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N° de publication : WO/2018/141197 N° de la demande internationale : PCT/CN2018/072097
Date de publication : 09.08.2018 Date de dépôt international : 10.01.2018
CIB :
H03M 1/38 (2006.01)
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
M
CODAGE, DÉCODAGE OU CONVERSION DE CODE, EN GÉNÉRAL
1
Conversion analogique/numérique; Conversion numérique/analogique
12
Convertisseurs analogiques/numériques
34
Valeur analogique comparée à des valeurs de référence
38
uniquement séquentiellement, p.ex. du type à approximations successives
Déposants :
HUAWEI TECHNOLOGIES CO., LTD. [CN/CN]; Huawei Administration Building, Bantian, Longgang District Shenzhen, Guangdong 518129, CN
Inventeurs :
CHONG, Euhan; CA
LEBEDEV, Semyon; CA
LACROIX, Marc-Andre; CA
Données relatives à la priorité :
15/425,65306.02.2017US
Titre (EN) ASYNCHRONOUS SAR ADC WITH CONVERSION SPEED CONTROL FEEDBACK LOOP
(FR) CONVERTISSEUR ANALOGIQUE/NUMÉRIQUE À REGISTRE D'APPROXIMATIONS SUCCESSIVES ASYNCHRONE À BOUCLE DE COMMANDE DE RÉTROACTION DE VITESSE DE CONVERSION
Abrégé :
(EN) Systems and circuits for feedback control of an asynchronous successive approximation register (SAR) analog-to-digital converter (ADC) are described. An example system includes the asynchronous SAR ADC (100). A timing detector circuit (302) is coupled to the asynchronous SAR ADC (100) to receive one or more internal signals (310) from the asynchronous SAR ADC (100). The timing detector circuit (302) outputs a timing detector signal (312) representing an internal timing of the SAR ADC (100). The timing detector signal (312) is generated based on the one or more internal signals (310). A regulator circuit (304) is coupled to the timing detector circuit (302) to receive the timing detector signal (312). The regulator circuit (304) is also coupled to the asynchronous SAR ADC (100) to output a feedback signal (314) to the asynchronous SAR ADC (100). The feedback signal (314) is generated based on the timing detector signal (312) to control the internal timing of the SAR ADC (100) to match a target timing.
(FR) Cette invention concerne des systèmes et des circuits de commande de rétroaction d'un convertisseur analogique-numérique (CAN) à registre d'approximations successives asynchrone (SAR). Un système donné à titre d'exemple comprend le CAN SAR asynchrone (100). Un circuit détecteur de synchronisation (302) est couplé au CAN SAR asynchrone (100) pour recevoir un ou plusieurs signaux internes (310) à partir du CAN SAR asynchrone (100). Le circuit détecteur de synchronisation (302) délivre en sortie un signal détecteur de synchronisation (312) représentant une synchronisation interne du CAN SAR (100). Le signal détecteur de synchronisation (312) est généré sur la base du/des signal/signaux interne(s) (310). Un circuit régulateur (304) est couplé au circuit détecteur synchronisation (302) pour recevoir le signal détecteur de synchronisation (312). Le circuit régulateur (304) est également couplé au CAN SAR asynchrone (100) pour délivrer en sortie un signal de rétroaction (314) au CAN SAR asynchrone (100). Le signal de rétroaction (314) est généré sur la base du signal détecteur de synchronisation (312) pour commander la synchronisation interne du CAN SAR (100) de sorte à ce qu'elle corresponde à une synchronisation cible.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
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Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)