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1. (WO2018137548) DISPOSITIF ET PROCÉDÉ DE SYNCHRONISATION D'HORLOGE
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N° de publication : WO/2018/137548 N° de la demande internationale : PCT/CN2018/073241
Date de publication : 02.08.2018 Date de dépôt international : 18.01.2018
CIB :
H04J 3/06 (2006.01)
H ÉLECTRICITÉ
04
TECHNIQUE DE LA COMMUNICATION ÉLECTRIQUE
J
COMMUNICATION MULTIPLEX
3
Systèmes multiplex à division de temps
02
Détails
06
Dispositions de synchronisation
Déposants :
华为技术有限公司 HUAWEI TECHNOLOGIES CO., LTD. [CN/CN]; 中国广东省深圳市 龙岗区坂田华为总部办公楼 Huawei Administration Building, Bantian,Longgang District Shenzhen, Guangdong 518129, CN
Inventeurs :
蔡院玲 CAI, Yuanling; CN
孟凡顺 MENG, Fanshun; CN
吕京飞 LV, Jingfei; CN
徐川 XU, Chuan; CN
Données relatives à la priorité :
201710064282.526.01.2017CN
Titre (EN) CLOCK SYNCHRONIZATION DEVICE AND METHOD
(FR) DISPOSITIF ET PROCÉDÉ DE SYNCHRONISATION D'HORLOGE
(ZH) 一种时钟同步装置及方法
Abrégé :
(EN) Disclosed in the present application are a clock synchronization device and method. The clock synchronization device comprises: N phase-frequency detectors, for determining N frequency deviations, the N phase-frequency detectors corresponding to the N frequency deviations one to one, the N phase-frequency detectors corresponding to N reference clock signals one to one, the N frequency deviations being the frequency deviations between a system clock signal and the N reference clock signals, the frequency deviation between the system clock signal and each reference clock signal being determined by the corresponding phase-frequency detector; a processor, for determining a compensation value according to the N frequency deviations determined by the N phase-frequency detectors, the compensation value being equal to the weighted average of the N frequency deviations, each frequency deviation of the N frequency deviations corresponding to one weight; and an oscillator, for generating a new system clock signal according to the compensation value determined by the processor.
(FR) La présente invention concerne un dispositif et un procédé de synchronisation d'horloge. Le dispositif de synchronisation d'horloge comprend : N détecteurs de fréquence de phase, utilisés pour déterminer N écarts de fréquence, les N détecteurs de fréquence de phase correspondant de manière biunivoque aux N écarts de fréquence, les N détecteurs de fréquence de phase correspondant de manière biunivoque à N signaux d'horloge de référence, les N écarts de fréquence étant les écarts de fréquence entre un signal d'horloge de système et les N signaux d'horloge de référence, l'écart de fréquence entre le signal d'horloge de système et chaque signal d'horloge de référence étant déterminé par le détecteur de fréquence de phase correspondant ; un processeur utilisé pour déterminer une valeur de compensation en fonction des N écarts de fréquence déterminés par les N détecteurs de fréquence de phase, la valeur de compensation étant égale à la moyenne pondérée des N écarts de fréquence, chaque écart de fréquence des N écarts de fréquence correspondant à un poids ; et un oscillateur, utilisé pour générer un nouveau signal d'horloge de système en fonction de la valeur de compensation déterminée par le processeur.
(ZH) 本申请公开了一种时钟同步装置及方法。该时钟同步装置包括:N个鉴频鉴相器,用于确定N个频率偏差,所述N个鉴频鉴相器与所述N个频率偏差一一对应,所述N个鉴频鉴相器与N个参考时钟信号一一对应,其中,所述N个频率偏差是系统时钟信号与所述N个参考时钟信号的频率偏差,所述系统时钟信号与每个参考时钟信号的频率偏差由对应的鉴频鉴相器确定;处理器,用于根据所述N个鉴频鉴相器确定的所述N个频率偏差,确定补偿值,所述补偿值等于所述N个频率偏差的加权平均值,所述N个频率偏差中的每个频率偏差分别对应一个权重;振荡器,用于根据所述处理器确定的补偿值生成新的系统时钟信号。
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Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
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Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : chinois (ZH)
Langue de dépôt : chinois (ZH)