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1. (WO2018126656) UNITÉ ET DISPOSITIF D'ATTAQUE DE LIGNE DE SUBSTRAT DE RÉSEAU, PROCÉDÉ D'ATTAQUE ET DISPOSITIF D'AFFICHAGE
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N° de publication : WO/2018/126656 N° de la demande internationale : PCT/CN2017/094820
Date de publication : 12.07.2018 Date de dépôt international : 28.07.2017
CIB :
G09G 3/36 (2006.01)
G PHYSIQUE
09
ENSEIGNEMENT; CRYPTOGRAPHIE; PRÉSENTATION; PUBLICITÉ; SCEAUX
G
DISPOSITIONS OU CIRCUITS POUR LA COMMANDE DE L'AFFICHAGE UTILISANT DES MOYENS STATIQUES POUR PRÉSENTER UNE INFORMATION VARIABLE
3
Dispositions ou circuits de commande présentant un intérêt uniquement pour l'affichage utilisant des moyens de visualisation autres que les tubes à rayons cathodiques
20
pour la présentation d'un ensemble de plusieurs caractères, p.ex. d'une page, en composant l'ensemble par combinaison d'éléments individuels disposés en matrice
34
en commandant la lumière provenant d'une source indépendante
36
utilisant des cristaux liquides
Déposants : BOE TECHNOLOGY GROUP CO., LTD.[CN/CN]; No.10 Jiuxianqiao Rd., Chaoyang District Beijing 100015, CN
Inventeurs : HAN, Mingfu; CN
SHANG, Guangliang; CN
YAO, Xing; CN
HAN, Seung Woo; CN
KIM, Jiha; CN
ZHENG, Haoliang; CN
YUAN, Lijun; CN
WANG, Zhichong; CN
Mandataire : LIU, SHEN & ASSOCIATES; 10th Floor, Building 1, 10 Caihefang Road, Haidian District Beijing 100080, CN
Données relatives à la priorité :
201710001592.203.01.2017CN
Titre (EN) ARRAY SUBSTRATE LINE DRIVING UNIT AND DEVICE, DRIVING METHOD AND DISPLAY DEVICE
(FR) UNITÉ ET DISPOSITIF D'ATTAQUE DE LIGNE DE SUBSTRAT DE RÉSEAU, PROCÉDÉ D'ATTAQUE ET DISPOSITIF D'AFFICHAGE
(ZH) 阵列基板行驱动单元、装置、驱动方法及显示装置
Abrégé :
(EN) An array substrate line driving unit and device, a driving method and a display device. The array substrate line driving unit comprises: an input circuit (10) connected to an input signal end (Input) and a pull-up node (PU); a pull-down circuit (30) connected to a first voltage signal end (LVGL) and the pull-up node (PU); a pull-down control circuit (20) connected to the pull-down circuit (30) via a pull-down node (PD); an output circuit (50) connected to a clock signal end (CLK), a second voltage signal end (VGL), and a control circuit (60); a reset circuit (40) connected to a reset signal end (Reset), the first voltage signal end (LVGL), and the pull-up node (PU); and a control circuit (60) connected to the pull-up node (PU) and the output circuit (50). In response to received input signals (input), the input circuit (10) controls the potential of the pull-up node (PU) (S1); in response to clock signals (CLK) inputted into the output circuit (50) and the potential of the pull-up node (PU), the output circuit (50) generates output signals (S2); and in response to the output signals (Outc, Gout) generated by the output circuit, the control circuit (60) is disconnected from the pull-up node (PU) (S3).
(FR) L'invention concerne une unité et un dispositif d'attaque de ligne de substrat de réseau, un procédé d'attaque et un dispositif d'affichage. L'unité d'attaque de ligne de substrat de réseau comprend : un circuit d'entrée (10) connecté à une extrémité de signal d'entrée (Entrée) et à un nœud de rappel vers le niveau haut (PU) ; un circuit de rappel vers le niveau bas (30) connecté à une première extrémité de signal de tension (LVGL) et au nœud de rappel vers le niveau haut (PU) ; un circuit de commande de rappel vers le niveau bas (20) connecté au circuit de rappel vers le niveau bas (30) par l'intermédiaire d'un nœud de rappel vers le niveau bas (PD) ; un circuit de sortie (50) connecté à une extrémité de signal d'horloge (CLK), à une seconde extrémité de signal de tension (VGL) et à un circuit de commande (60) ; un circuit de réinitialisation (40) connecté à une extrémité de signal de réinitialisation (Réinitialisation), à la première extrémité de signal de tension (LVGL) et au nœud de rappel vers le niveau haut (PU) ; et le circuit de commande (60) connecté au nœud de rappel vers le niveau haut (PU) et au circuit de sortie (50). En réponse aux signaux d'entrée (Entrée) reçus, le circuit d'entrée (10) commande le potentiel du nœud de rappel vers le niveau haut (PU) (S1), en réponse à des signaux d'horloge (CLK) entrés dans le circuit de sortie (50) et au potentiel du nœud de rappel vers le niveau haut (PU), le circuit de sortie (50) génère des signaux de sortie (S2), et, en réponse aux signaux de sortie (Outc, Gout) générés par le circuit de sortie, le circuit de commande (60) est déconnecté du nœud de rappel vers le niveau haut (PU) (S3).
(ZH) 一种阵列基板行驱动单元、装置、驱动方法及显示装置。阵列基板行驱动单元包括:输入电路(10),连接到输入信号端(Input)和上拉节点(PU);下拉电路(30),连接到第一电压信号端(LVGL)和上拉节点(PU);下拉控制电路(20),经由下拉节点(PD)连接到下拉电路(30);输出电路(50),连接到时钟信号端(CLK)、第二电压信号端(VGL)和控制电路(60);复位电路(40),连接到复位信号端(Reset)、第一电压信号端(LVGL)和上拉节点(PU);和控制电路(60),连接到上拉节点(PU)和输出电路(50)。其中输入电路(10)响应于所接收的输入信号(input),控制上拉节点(PU)的电位(S1);输出电路(50)响应于输入到输出电路(50)的时钟信号(CLK)以及上拉节点(PU)的电位,生成输出信号(S2);控制电路(60)响应于输出电路所生成的输出信号(Outc、Gout),断开其与上拉节点(PU)的连接(S3)。
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : chinois (ZH)
Langue de dépôt : chinois (ZH)