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1. (WO2018104828) CODEUR, DÉCODEUR ET RÉCEPTEUR DE TÉLÉVISION
Dernières données bibliographiques dont dispose le Bureau international    Formuler une observation

N° de publication :    WO/2018/104828    N° de la demande internationale :    PCT/IB2017/057512
Date de publication : 14.06.2018 Date de dépôt international : 30.11.2017
CIB :
H04N 19/625 (2014.01), H01L 21/8234 (2006.01), H01L 27/06 (2006.01), H01L 27/088 (2006.01), H01L 29/786 (2006.01), H03M 7/30 (2006.01), H04N 19/42 (2014.01)
Déposants : SEMICONDUCTOR ENERGY LABORATORY CO., LTD. [JP/JP]; 398, Hase Atsugi-shi Kanagawa 2430036 (JP)
Inventeurs : INOUE, Hiroki; (JP).
KUROKAWA, Yoshiyuki; (JP).
NAKAGAWA, Takashi; (JP).
AKASAWA, Fumika; (JP)
Données relatives à la priorité :
2016-238959 09.12.2016 JP
Titre (EN) ENCODER, DECODER, AND TELEVISION RECEIVER
(FR) CODEUR, DÉCODEUR ET RÉCEPTEUR DE TÉLÉVISION
Abrégé : front page image
(EN)To provide a decoder whose area is reduced. The decoder includes an inverse discrete cosine transform (IDCT) circuit. The IDCT circuit includes a multiplier circuit. The multiplier circuit includes an arithmetic circuit that multiplies a first current and a second current, a current generator that generates the first current, and a digital-analog converter that generates a reference current used by the current generator. The current generator includes a current mirror circuit (CM circuit) including first and second transistors, a third transistor, a switch that controls the current output, and first and second memory circuits. The reference current of the CM circuit is input to a drain of the first transistor, and a current which copies the reference current is output from a drain of the second transistor. A drain of the third transistor is electrically connected to the drain of the second transistor. The switch controls the first current output.
(FR)L'invention concerne la fourniture d'un décodeur à zone réduite. Le décodeur comprend un circuit de transformée en cosinus discrète inverse (IDCT). Le circuit IDCT comprend un circuit multiplicateur. Le circuit multiplicateur comprend un circuit arithmétique qui multiplie un premier courant et un second courant, un générateur de courant qui génère le premier courant et un convertisseur numérique-analogique qui génère un courant de référence utilisé par le générateur de courant. Le générateur de courant comprend un circuit miroir de courant (circuit CM) comprenant des premier et deuxième transistors, un troisième transistor, un commutateur qui commande la sortie de courant et des premier et second circuits de mémoire. Le courant de référence du circuit CM est entré dans un drain du premier transistor et un courant qui copie le courant de référence est émis par un drain du deuxième transistor. Un drain du troisième transistor est connecté au drain du deuxième transistor. Le commutateur commande la première sortie de courant.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)