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1. (WO2018103391) PROCÉDÉ, DISPOSITIF ET SYSTÈME DE CORRECTION DE DÉCALAGE D'HORLOGE
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N° de publication : WO/2018/103391 N° de la demande internationale : PCT/CN2017/100501
Date de publication : 14.06.2018 Date de dépôt international : 05.09.2017
CIB :
G06F 1/12 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
1
Détails non couverts par les groupes G06F3/-G06F13/89
04
Génération ou distribution de signaux d'horloge ou de signaux dérivés directement de ceux-ci
12
Synchronisation des différents signaux d'horloge
Déposants :
郑州云海信息技术有限公司 ZHENGZHOU YUNHAI INFORMATION TECHNOLOGY CO., LTD. [CN/CN]; 中国河南省郑州市 郑东新区心怡路278号 No. 278 Xinyi Road, ZhengDong New District Zhengzhou, Henan 450000, CN
Inventeurs :
刘涛 LIU, Tao; CN
Mandataire :
济南信达专利事务所有限公司 JINAN XINDA PATENT OFFICE CO.,LTD.; 中国山东省济南市 历下区经十东路12588号名士豪庭小区MINI公馆202房间姜明 MING, Jiang Rm. 202, Mini Bldg., Mingshihaoting #12588, Jingshidong Rd., Lixia District Jinan, Shandong 250014, CN
Données relatives à la priorité :
201611119531.808.12.2016CN
Titre (EN) CLOCK SKEW CORRECTION METHOD, DEVICE AND SYSTEM
(FR) PROCÉDÉ, DISPOSITIF ET SYSTÈME DE CORRECTION DE DÉCALAGE D'HORLOGE
(ZH) 一种时钟偏斜校正方法、装置和系统
Abrégé :
(EN) Provided are a clock skew correction method, device and system. The method comprises: determining at least two assemblies (101); when a clock generation source transmits a clock signal for each of the assemblies, determining a cycle duration of the clock signal, and calculating a delay parameter of each of the assemblies (102); selecting one slave assembly and at least one master assembly from the at least two assemblies (103); according to the delay parameter of the slave assembly, correcting a clock phase corresponding to each of the master assemblies (104); and with regard to each of the master assemblies, according to the cycle duration and the corrected clock phase corresponding to the master assembly, generating a corrected clock corresponding to the master assembly (105). The solution achieves the correction of clock skew.
(FR) L'invention concerne un procédé, un dispositif et un système de correction de décalage d'horloge. Le procédé comprend les étapes suivantes : déterminer au moins deux ensembles (101) ; lorsqu'une source de production d'horloge transmet un signal d'horloge pour chacun des ensembles, déterminer une durée de cycle du signal d'horloge, et calculer un paramètre de retard de chacun des ensembles (102) ; sélectionner un ensemble esclave et au moins un ensemble maître parmi lesdits deux ensembles (103) ; selon le paramètre de retard de l'ensemble esclave, corriger une phase d'horloge correspondant à chacun des ensembles maîtres (104) ; et par rapport à chacun des ensembles maîtres, selon la durée de cycle et la phase d'horloge corrigée correspondant à l'ensemble maître, produire une horloge corrigée correspondant à l'ensemble maître (105). La solution effectue la correction de décalage d'horloge.
(ZH) 一种时钟偏斜校正方法、装置和系统,通过确定至少两个组件(101),当时钟发生源为每一个所述组件传输时钟信号时,确定时钟信号的周期时长,并计算每一个所述组件的延迟参数(102);在所述至少两个组件中,选定一个从组件和至少一个主组件(103);根据所述从组件的延迟参数,校正每一个所述主组件对应的时钟相位(104);针对每一个所述主组件,执行:根据所述周期时长和所述主组件对应的校正后的时钟相位,为所述主组件生成对应的校正时钟(105)。该方案实现了对时钟偏斜的校正。
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Langue de publication : chinois (ZH)
Langue de dépôt : chinois (ZH)