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1. (WO2018076978) SYSTÈME D'ACCÈS À DES DONNÉES, PROCÉDÉ D'ÉCRITURE DE DONNÉES ET PROCÉDÉ DE LECTURE DE DONNÉES

Pub. No.:    WO/2018/076978    International Application No.:    PCT/CN2017/103055
Publication Date: Fri May 04 01:59:59 CEST 2018 International Filing Date: Sun Sep 24 01:59:59 CEST 2017
IPC: G11C 16/10
Applicants: HUAWEI TECHNOLOGIES CO., LTD.
华为技术有限公司
Inventors: LI, Wei
李伟
GU, Xiongli
顾雄礼
DONG, Xiaowen
董晓文
Title: SYSTÈME D'ACCÈS À DES DONNÉES, PROCÉDÉ D'ÉCRITURE DE DONNÉES ET PROCÉDÉ DE LECTURE DE DONNÉES
Abstract:
L'invention concerne un système d'accès à des données, un procédé d'écriture de données et un procédé de lecture de données, qui appartiennent au domaine des communications. Le système d'accès à des données comprend un circuit de génération d'horloge système, un circuit de génération d'horloge à multiplication de fréquence, un cœur de processeur et une mémoire cache, le cœur et la mémoire cache étant reliés au moyen d'une interface réseau ; la largeur de bit de transmission de données de l'interface réseau est de m1 bit ; la mémoire cache contient au moins un module de mémoire aléatoire ayant x ports ; le module de mémoire aléatoire comprend une pluralité de lignes de stockage ayant une largeur de bit qui est m2 bit ; et x * n lignes de stockage dans celle-ci forment une ligne de mémoire cache de la mémoire cache, où x * n * m2 = m1. Selon certains modes de réalisation de la présente invention, un mode de multiplexage par répartition temporelle est utilisé de sorte qu'un seul module de mémoire aléatoire réalise l'écriture de premières données de ligne de mémoire cache ou la lecture de secondes données de ligne de mémoire cache dans n périodes d'horloge de multiplication de fréquence, et une pluralité de modules de mémoire aléatoires qui sont spatialement parallèles sont convertis en un seul module de mémoire aléatoire qui est parallèle dans le temps, ce qui permet d'améliorer le taux d'utilisation des ressources du module de mémoire aléatoire.