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1. (WO2018063510) DIAGNOSTIC INTELLIGENT DE CIRCUITS INTÉGRÉS COMPRENANT DES CŒURS IP AYANT DES MODÈLES DE SIMULATION CHIFFRÉS
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N° de publication : WO/2018/063510 N° de la demande internationale : PCT/US2017/045999
Date de publication : 05.04.2018 Date de dépôt international : 09.08.2017
CIB :
G06F 21/76 (2013.01) ,G06F 21/72 (2013.01) ,G06F 17/50 (2006.01) ,G06F 11/36 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
21
Dispositions de sécurité pour protéger les calculateurs, leurs composants, les programmes ou les données contre une activité non autorisée
70
Protection de composants spécifiques internes ou périphériques, où la protection d'un composant mène à la protection de tout le calculateur
71
pour assurer la sécurité du calcul ou du traitement de l’information
76
dans les circuits intégrés à application spécifique [ASICs] ou les dispositifs programmables, p.ex. les réseaux de portes programmables [FPGAs] ou les circuits logiques programmables [PLDs]
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
21
Dispositions de sécurité pour protéger les calculateurs, leurs composants, les programmes ou les données contre une activité non autorisée
70
Protection de composants spécifiques internes ou périphériques, où la protection d'un composant mène à la protection de tout le calculateur
71
pour assurer la sécurité du calcul ou du traitement de l’information
72
dans les circuits de cryptographie
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
17
Equipement ou méthodes de traitement de données ou de calcul numérique, spécialement adaptés à des fonctions spécifiques
50
Conception assistée par ordinateur
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
11
Détection d'erreurs; Correction d'erreurs; Contrôle de fonctionnement
36
Prévention d'erreurs en effectuant des tests ou par débogage de logiciel
Déposants :
ALTERA CORPORATION [US/US]; 101 Innovation Drive San Jose, CA 95134-1941, US
Inventeurs :
VIJAYENDRA, Vishwas Tumkur; US
ZHOU, Bo; US
Mandataire :
CHO, Lawrence M.; US
Données relatives à la priorité :
15/278,05128.09.2016US
Titre (EN) SMART DIAGNOSIS OF INTEGRATED CIRCUITS INCLUDING IP CORES WITH ENCRYPTED SIMULATION MODELS
(FR) DIAGNOSTIC INTELLIGENT DE CIRCUITS INTÉGRÉS COMPRENANT DES CŒURS IP AYANT DES MODÈLES DE SIMULATION CHIFFRÉS
Abrégé :
(EN) The present embodiments relate to methods for simulating the behavior of an IP core that has an encrypted simulation model. The encrypted simulation model of the IP core may include a plurality of probes, which a debug option may activate selectively, if desired. The encrypted simulation model may collect data during a simulation as selected by the activated probes of the plurality of probes. The encrypted simulation model may perform smart diagnosis of the collected data based on a set of rules and generate feedback messages that may suggest corrective action in the event of a simulation failure.
(FR) La présente invention concerne, selon des modes de réalisation, des procédés de simulation du comportement d'un cœur IP qui possède un modèle de simulation chiffré. Le modèle de simulation chiffré du cœur IP peut comprendre une pluralité de sondes qu'une option de débogage peut activer sélectivement si nécessaire. Le modèle de simulation chiffré peut collecter des données durant une simulation sélectionnée par les sondes activées de la pluralité de sondes. Le modèle de simulation chiffré peut effectuer un diagnostic intelligent des données collectées sur la base d'un ensemble de règles et générer des messages de rétroaction qui peuvent suggérer une action corrective en cas de défaillance de simulation.
front page image
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)