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1. (WO2018061192) DISPOSITIF DE TRAITEMENT D'INFORMATIONS
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N° de publication : WO/2018/061192 N° de la demande internationale : PCT/JP2016/079083
Date de publication : 05.04.2018 Date de dépôt international : 30.09.2016
CIB :
G06F 12/08 (2016.01) ,G06F 12/12 (2016.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12
Accès, adressage ou affectation dans des systèmes ou des architectures de mémoire
02
Adressage ou affectation; Réadressage
08
dans des systèmes de mémoires hiérarchiques, p.ex. systèmes de mémoire virtuelle
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12
Accès, adressage ou affectation dans des systèmes ou des architectures de mémoire
02
Adressage ou affectation; Réadressage
08
dans des systèmes de mémoires hiérarchiques, p.ex. systèmes de mémoire virtuelle
12
Commande de remplacement
Déposants :
三菱電機株式会社 MITSUBISHI ELECTRIC CORPORATION [JP/JP]; 東京都千代田区丸の内二丁目7番3号 7-3, Marunouchi 2-chome, Chiyoda-ku, Tokyo 1008310, JP
Inventeurs :
武田 清大 TAKEDA, Seidai; JP
Mandataire :
特許業務法人深見特許事務所 FUKAMI PATENT OFFICE, P.C.; 大阪府大阪市北区中之島三丁目2番4号 中之島フェスティバルタワー・ウエスト Nakanoshima Festival Tower West, 2-4, Nakanoshima 3-chome, Kita-ku, Osaka-shi, Osaka 5300005, JP
Données relatives à la priorité :
Titre (EN) INFORMATION PROCESSING DEVICE
(FR) DISPOSITIF DE TRAITEMENT D'INFORMATIONS
(JA) 情報処理装置
Abrégé :
(EN) This information processing device is provided with a plurality of calculation devices (AR1-AR5), a memory unit (MEM) shared by the plurality of calculation devices, and a cache device (10). The cache device (10) divides the memory space of the memory unit (MEM) into a plurality of regions (RG1-RG4), and includes a plurality of caches (CS1-CS4) that belong to the same tier and that are respectively associated with the plurality of regions. Each cache (CS) includes a cache core unit (20) that exclusively stores data from a respective one of the plurality of regions.
(FR) Ce dispositif de traitement d'informations est pourvu d'une pluralité de dispositifs de calcul (AR1-AR5), d'une unité de mémoire (MEM) partagée par la pluralité de dispositifs de calcul, et d'un dispositif de cache (10). Le dispositif de cache divise l'espace mémoire de l'unité de mémoire (MEM) en une pluralité de régions (RG1-RG4), et comprend une pluralité de caches (CS1-CS4) qui appartiennent au même niveau et qui sont respectivement associés à la pluralité de régions. Chaque mémoire cache (CS) comprend une unité centrale de mémoire cache (20) qui stocke exclusivement des données provenant d'une région respective de la pluralité de régions.
(JA) 情報処理装置は、複数の演算装置(AR1~AR5)と、複数の演算装置によって共有されるメモリ部(MEM)と、キャッシュ装置(10)とを備える。キャッシュ装置(10)は、メモリ部(MEM)のメモリ空間を複数の領域(RG1~RG4)に分割し、複数の領域にそれぞれ対応する同一階層の複数のキャッシュ(CS1~CS4)を含む。各キャッシュ(CS)は、対応する領域のデータが独占的に配置されるキャッシュコア部(20)を含む。
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)