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1. (WO2018057115) STOCKAGE DE DONNÉES À DES ADRESSES DE MÉMOIRE CONTIGUËS
Dernières données bibliographiques dont dispose le Bureau international    Formuler une observation

N° de publication :    WO/2018/057115    N° de la demande internationale :    PCT/US2017/044227
Date de publication : 29.03.2018 Date de dépôt international : 27.07.2017
CIB :
H03M 7/30 (2006.01)
Déposants : QUALCOMM INCORPORATED [US/US]; ATTN: International IP Administration 5775 Morehouse Drive San Diego, California 92121-1714 (US)
Inventeurs : MAHURIN, Eric; (US).
HOYLE, David; (US)
Mandataire : TOLER, JEFFREY G.; 8500 Bluffstone Cove, Suite A201 Austin, Texas 78759 (US).
MOORE, Jason L.; (US).
ROBERTSON, Jason E.; (US).
PAREKH, Aakash; (US)
Données relatives à la priorité :
15/273,366 22.09.2016 US
Titre (EN) DATA STORAGE AT CONTIGUOUS MEMORY ADDRESSES
(FR) STOCKAGE DE DONNÉES À DES ADRESSES DE MÉMOIRE CONTIGUËS
Abrégé : front page image
(EN)A method for storing data at contiguous memory addresses includes, at a single-instruction-multiple-data (SIMD) processor, executing a parallel-prefix valid count instruction to determine a first offset of a first data vector and to determine a second offset of a second data vector that includes valid data and invalid data. The second offset is based on the first offset and a number of positions in the first data vector that are associated with valid data. The method also includes storing first valid data from the first data vector at a first memory address of a memory and storing second valid data from the second data vector at a particular memory address of the memory. The first memory address is based on the first offset and the particular memory address is based on the second offset.
(FR)Cette invention concerne un procédé de stockage de données à des adresses de mémoire contiguës, comprenant, au niveau d'un processeur à instruction unique-données multiples (SIMD), l'exécution d'une instruction de comptage de validité à préfixes en parallèle pour déterminer un premier décalage d'un premier vecteur de données et déterminer un second décalage d'un deuxième vecteur de données qui comprend des données valides et des données invalides. Le second décalage est basé sur le premier décalage et un certain nombre de positions dans le premier vecteur de données qui sont associées à des données valides. Le procédé comprend également le stockage de premières données valides à partir du premier vecteur de données à une première adresse de mémoire d'une mémoire et le stockage de secondes données valides à partir du deuxième vecteur de données à une adresse de mémoire particulière de la mémoire. La première adresse de mémoire est basée sur le premier décalage et l'adresse de mémoire particulière est basée sur le second décalage.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)