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1. (WO2018048564) TRADUCTION SUR UNE ENTRÉE DE MACHINE VIRTUELLE
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N° de publication : WO/2018/048564 N° de la demande internationale : PCT/US2017/046158
Date de publication : 15.03.2018 Date de dépôt international : 09.08.2017
CIB :
G06F 12/10 (2006.01) ,G06F 9/455 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12
Accès, adressage ou affectation dans des systèmes ou des architectures de mémoire
02
Adressage ou affectation; Réadressage
08
dans des systèmes de mémoires hiérarchiques, p.ex. systèmes de mémoire virtuelle
10
Traduction d'adresses
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9
Dispositions pour la commande par programme, p.ex. unité de commande
06
utilisant un programme emmagasiné, c. à. d. utilisant une unité de stockage interne de l'équipement de traitement de données pour recevoir et conserver le programme
44
Dispositions pour exécuter des programmes spécifiques
455
Emulation; Simulation de logiciel
Déposants : INTEL CORPORATION[US/US]; 2200 Mission College Boulevard Santa Clara, California 95054, US
Inventeurs : SHANBHOGUE, Vedvyas; US
NEIGER, Gilbert; US
HUNTLEY, Barry E.; US
Mandataire : PORTNOVA, Marina; US
GREENE, Nathan; US
ANDREEV, Dmitry; US
Données relatives à la priorité :
15/259,41108.09.2016US
Titre (EN) TRANSLATE ON VIRTUAL MACHINE ENTRY
(FR) TRADUCTION SUR UNE ENTRÉE DE MACHINE VIRTUELLE
Abrégé :
(EN) A processor includes a core with virtualization support circuitry to, in response to a request to access an instruction, retrieve a logical address from a virtual machine control structure (VMCS) associated with a virtual machine. The logical address corresponds to the instruction to be accessed. The virtualization support circuitry may further translate the logical address to a guest virtual address; invoke translation circuitry to translate the guest virtual address to a guest physical address, and translate the guest physical address to a host physical address; and store at least one of the guest physical address or the host physical address in the VMCS.
(FR) Un processeur comprend un cœur pourvu de circuits de prise en charge de virtualisation conçus pour, en réponse à une demande de consultation d'une instruction, récupérer une adresse logique provenant d'une structure de commande de machine virtuelle (VMCS) associée à une machine virtuelle. L'adresse logique correspond à l'instruction devant être consultée. Les circuits de prise en charge de virtualisation peuvent en outre : traduire l'adresse logique en une adresse virtuelle d'invité ; appeler des circuits de traduction conçus pour traduire l'adresse virtuelle d'invité en une adresse physique d'invité et pour traduire l'adresse physique d'invité en une adresse physique d'hôte ; et stocker l'adresse physique d'invité et/ou l'adresse physique d'hôte dans la VMCS.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)