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1. (WO2018042288) RÉCEPTEUR DESTINÉ À LA RÉCEPTION D'UN SIGNAL DIFFÉRENTIEL, CI COMPRENANT UN RÉCEPTEUR, ET DISPOSITIF D'AFFICHAGE
Dernières données bibliographiques dont dispose le Bureau international    Formuler une observation

N° de publication :    WO/2018/042288    N° de la demande internationale :    PCT/IB2017/055070
Date de publication : 08.03.2018 Date de dépôt international : 23.08.2017
CIB :
H03K 19/0175 (2006.01), G09G 3/20 (2006.01), G09G 3/3233 (2016.01), G09G 3/36 (2006.01), H03F 3/45 (2006.01), H04L 25/02 (2006.01)
Déposants : SEMICONDUCTOR ENERGY LABORATORY CO., LTD. [JP/JP]; 398, Hase Atsugi-shi, Kanagawa 2430036 (JP)
Inventeurs : INOUE, Hiroki; (JP).
TAKAHASHI, Kei; (JP)
Données relatives à la priorité :
2016-167915 30.08.2016 JP
Titre (EN) RECEIVER FOR RECEIVING DIFFERENTIAL SIGNAL, IC INCLUDING RECEIVER, AND DISPLAY DEVICE
(FR) RÉCEPTEUR DESTINÉ À LA RÉCEPTION D'UN SIGNAL DIFFÉRENTIEL, CI COMPRENANT UN RÉCEPTEUR, ET DISPOSITIF D'AFFICHAGE
Abrégé : front page image
(EN)The transmission delay time of a receiver for receiving a differential signal is reduced. A first amplifier circuit is provided in an input stage of the receiver, and a second amplifier circuit is provided in an output stage of the receiver. The first amplifier circuit is a differential input, differential output amplifier circuit. The second amplifier circuit is a differential input, single-ended output amplifier circuit. A first power supply voltage and a second power supply voltage are input as a high-level power supply voltage and a low-level power supply voltage to the first amplifier circuit and the second amplifier circuit, respectively. The withstand voltage of transistors of a differential pair of the first amplifier circuit is higher than the withstand voltage of another transistor included in the first amplifier circuit and a transistor included in the second amplifier circuit.
(FR)Selon l'invention, le retard de transmission d'un récepteur concernant la réception d'un signal différentiel est réduit. Un premier circuit amplificateur est disposé dans un étage d'entrée du récepteur, et un second circuit amplificateur est disposé dans un étage de sortie du récepteur. Le premier circuit amplificateur est un circuit amplificateur à entrée et sortie différentielles. Le second circuit amplificateur est un circuit amplificateur à entrée différentielle et à sortie à extrémité unique. Des première et seconde tensions d'alimentation électrique sont appliquées en tant que tensions d'alimentation électrique élevée et faible aux premier et second circuits amplificateurs, respectivement. La tension de tenue des transistors d'une paire différentielle du premier circuit amplificateur est supérieure à la tension de tenue d'un autre transistor inclus dans le premier circuit amplificateur et d'un transistor inclus dans le second circuit amplificateur.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)