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1. (WO2018039855) DISPOSITIF DE MÉMOIRE, CONTRÔLEUR DE MÉMOIRE, DISPOSITIF DE MISE DE DONNÉES EN ANTÉMÉMOIRE, ET SYSTÈME INFORMATIQUE
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N° de publication : WO/2018/039855 N° de la demande internationale : PCT/CN2016/097130
Date de publication : 08.03.2018 Date de dépôt international : 29.08.2016
CIB :
G06F 13/16 (2006.01)
Déposants : HUAWEI TECHNOLOGIES CO., LTD.[CN/CN]; Huawei Administration Building Bantian, Longgang Shenzhen, Guangdong 518129, CN
Inventeurs : XIAO, Shihai; CN
YANG, Wei; CN
Mandataire : LONGSUN LEAD IP LTD.; Rm.101, Building 3 No. 68 Beiqing Road, Haidian District Beijing 100094, CN
Données relatives à la priorité :
Titre (EN) MEMORY DEVICE, MEMORY CONTROLLER, DATA CACHING DEVICE, AND COMPUTER SYSTEM
(FR) DISPOSITIF DE MÉMOIRE, CONTRÔLEUR DE MÉMOIRE, DISPOSITIF DE MISE DE DONNÉES EN ANTÉMÉMOIRE, ET SYSTÈME INFORMATIQUE
(ZH) 内存装置、内存控制器、数据缓存装置及计算机系统
Abrégé : front page image
(EN) Provided are a memory device, a memory controller, a data caching device, and a computer system. The memory device (20) comprises: an NVM (24); an NVM controller (22) connected to a memory controller by means of a DDR bus. The NVM controller (22) performs, according to a command of the memory controller, an access operation with respect to the NVM (24), and performs data transmission with the memory controller on a part of DQS signal lines in the DDR bus. The memory device (20) transmits data by means of a part of the DQS signal lines in the DDR bus, thereby solving a problem in which extra data is unable to be transmitted between a memory controller and a memory device.
(FR) L'invention concerne un dispositif de mémoire, un contrôleur de mémoire, un dispositif de mise de données en antémémoire, et un système informatique. Le dispositif de mémoire (20) comprend : une NVM (24) ; et un contrôleur de NVM (22) connecté à un contrôleur de mémoire au moyen d'un bus DDR. Le contrôleur de NVM (22) effectue une opération d'accès par rapport à la NVM (24) selon une commande du contrôleur de mémoire, et effectue une transmission de données avec le contrôleur de mémoire sur une partie de lignes de signaux DQS dans le bus DDR. Le dispositif de mémoire (20) transmet des données au moyen d'une partie des lignes de signaux DQS dans le bus DDR, ce qui permet de résoudre le problème selon lequel il est impossible de transmettre des données supplémentaires entre un contrôleur de mémoire et un dispositif de mémoire.
(ZH) 一种内存装置、内存控制器、数据缓存装置及计算机系统,该内存装置(20)包括:NVM(24);NVM控制器(22),通过DDR总线与内存控制器相连,所述NVM控制器(22)根据所述内存控制器的命令对所述NVM(24)进行访存操作,并在所述DDR总线中的部分DQS信号线上与所述内存控制器进行数据传输。所述内存装置(20)利用DDR总线中的部分DQS信号线传输数据,解决了内存控制器和内存装置之间无法传递额外数据的问题。
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : chinois (ZH)
Langue de dépôt : chinois (ZH)