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1. (WO2018038830) MULTIPLICATEUR À VIRGULE FLOTTANTE DE PRÉCISION VARIABLE
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N° de publication : WO/2018/038830 N° de la demande internationale : PCT/US2017/043154
Date de publication : 01.03.2018 Date de dépôt international : 20.07.2017
CIB :
G06F 7/487 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
7
Méthodes ou dispositions pour le traitement de données en agissant sur l'ordre ou le contenu des données manipulées
38
Méthodes ou dispositions pour effectuer des calculs en utilisant exclusivement une représentation numérique codée, p.ex. en utilisant une représentation binaire, ternaire, décimale
48
utilisant des dispositifs n'établissant pas de contact, p.ex. tube, dispositif à l'état solide; utilisant des dispositifs non spécifiés
483
Calculs avec des nombres représentés par une combinaison non linéaire de nombres codés, p.ex. nombres rationnels, système de numération logarithmique ou nombres à virgule flottante
487
Multiplication; Division
Déposants :
ALTERA CORPORATION [US/US]; 101 Innovation Drive San Jose, CA 95134, US
Inventeurs :
LANGHAMMER, Martin; GB
Mandataire :
TSAI, Jason; US
Données relatives à la priorité :
15/242,92322.08.2016US
Titre (EN) VARIABLE PRECISION FLOATING-POINT MULTIPLIER
(FR) MULTIPLICATEUR À VIRGULE FLOTTANTE DE PRÉCISION VARIABLE
Abrégé :
(EN) Integrated circuits with specialized processing blocks are provided. The specialized processing blocks may include floating-point multiplier circuits that can be configured to support variable precision. A multiplier circuit may include a first carry-propagate adder (CPA), a second carry-propagate adder (CPA), and an associated rounding circuit. The first CPA may be wide enough to handle the required precision of the mantissa. In a bridged mode, the first CPA may borrow an additional bit from the second CPA while the rounding circuit will monitor the appropriate bits to select the proper multiplier output. A parallel prefix tree operable in a non-bridged mode or the bridged mode may be used to compute multiple multiplier outputs. The multiplier circuit may also include exponent and exception handling circuitry using various masks corresponding to the desired precision width.
(FR) L'invention concerne également des circuits intégrés avec des blocs de traitement spécialisés. Les blocs de traitement spécialisés peuvent comprendre des circuits multiplicateurs à virgule flottante qui peuvent être configurés pour supporter une précision variable. Un circuit multiplicateur peut comprendre un premier additionneur de propagation de report (CPA), un second additionneur de propagation de report (CPA), et un circuit d'arrondi associé. Le premier CPA peut être suffisamment large pour gérer la précision requise de la mantisse. Dans un mode ponté (bridge), le premier CPA peut emprunter un bit supplémentaire du second CPA tandis que le circuit d'arrondi surveille les bits appropriés pour sélectionner la sortie de multiplicateur appropriée. Un arbre de préfixe parallèle utilisable dans un mode non ponté(non-bridged) ou le mode ponté peut être utilisé pour calculer de multiples sorties de multiplicateur. Le circuit multiplicateur peut également comprendre des circuits de traitement d'exposant et d'exception utilisant divers masques correspondant à la largeur de précision souhaitée.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
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Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)