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1. (WO2017212187) SYSTEME ET PROCEDE POUR FOURNIR L'AMPLITUDE ET LE RETARD DE PHASE D'UN SIGNAL SINUSOÏDAL
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N° de publication :    WO/2017/212187    N° de la demande internationale :    PCT/FR2017/051464
Date de publication : 14.12.2017 Date de dépôt international : 09.06.2017
CIB :
G01R 19/04 (2006.01), G01R 19/175 (2006.01), G01R 25/00 (2006.01), G06F 17/12 (2006.01), G06F 17/16 (2006.01), G01P 3/14 (2006.01), G01P 15/18 (2013.01), G06F 17/14 (2006.01)
Déposants : OFFICE NATIONAL D'ETUDES ET DE RECHERCHES AÉROSPATIALES [FR/FR]; Chemin de la Hunière 91120 PALAISEAU (FR)
Inventeurs : GUERARD, Jean; (FR).
VERLHAC, Béatrice; (FR).
LAVENUS, Pierre; (FR).
LEVY, Raphaël; (FR)
Mandataire : CABINET PLASSERAUD; 66 rue de la Chaussée d'Antin 75440 PARIS CEDEX 09 (FR)
Données relatives à la priorité :
16 55330 10.06.2016 FR
Titre (EN) SYSTEM AND METHOD FOR PROVIDING THE AMPLITUDE AND PHASE DELAY OF A SINUSOIDAL SIGNAL
(FR) SYSTEME ET PROCEDE POUR FOURNIR L'AMPLITUDE ET LE RETARD DE PHASE D'UN SIGNAL SINUSOÏDAL
Abrégé : front page image
(EN)The invention relates to a system and method that provide an amplitude value (A) and a phase delay value (Φ) related to a sinusoidal signal to be measured (s(t)). For this purpose, phase values (ψk) of a reference signal (r(t)), at which the signal to be measured exceeds or falls below the reference signal, are collected and transmitted to a computation unit (3). The computation unit determines the amplitude and delay values from said collected phase values. The system can be produced in a cost-effective manner, in particular using an ASIC circuit or an FPGA circuit.
(FR)Un système et un procédé fournissent une valeur d'amplitude (A) et une valeur de retard de phase (Φ) qui sont relatives à un signal sinusoïdal à mesurer (s(t)). Pour cela, des valeurs de phase (ψk) d'un signal de référence (r(t)), auxquelles ledit signal à mesurer devient supérieur ou inférieur audit signal de référence, sont collectées et transmises à une unité de calcul (3). L'unité de calcul détermine les valeurs de l'amplitude et du retard à partir desdites valeurs de phase collectées. Le système peut être réalisé de façon économique, notamment à l'aide d'un circuit ASIC ou d'un circuit FGPA.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : français (FR)
Langue de dépôt : français (FR)