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1. (WO2017172168) SYSTÈME DE COMMUNICATION DE BUS DE CAPTEUR
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N° de publication : WO/2017/172168 N° de la demande internationale : PCT/US2017/019736
Date de publication : 05.10.2017 Date de dépôt international : 27.02.2017
CIB :
G06F 13/38 (2006.01) ,G06F 13/42 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
13
Interconnexion ou transfert d'information ou d'autres signaux entre mémoires, dispositifs d'entrée/sortie ou unités de traitement
38
Transfert d'informations, p.ex. sur un bus
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
13
Interconnexion ou transfert d'information ou d'autres signaux entre mémoires, dispositifs d'entrée/sortie ou unités de traitement
38
Transfert d'informations, p.ex. sur un bus
42
Protocole de transfert pour bus, p.ex. liaison; Synchronisation
Déposants :
INTEL CORPORATION [US/US]; 2200 Mission College Blvd. Santa Clara, California 95054, US
Inventeurs :
SRIVASTAVA, Amit Kumar; MY
Mandataire :
NICHOLSON, JR., Wesley E.; US
Données relatives à la priorité :
15/086,70031.03.2016US
Titre (EN) SENSOR BUS COMMUNICATION SYSTEM
(FR) SYSTÈME DE COMMUNICATION DE BUS DE CAPTEUR
Abrégé :
(EN) Described is an I3C Repeater. The I3C Repeater may have a first circuitry with an I3C interface, a second circuitry with an I2C interface, and a datapath circuitry coupled to the first circuitry and the second circuitry. The second circuitry may be operable to convert a transaction received on the I2C interface into a transaction for the I3C interface, and to convert a transaction received on the I3C interface into a transaction for the I2C interface. The I3C Repeater may also have additional circuitries operable to convert transactions received on one of an SPI interface, a UART interface, and a Debug bus interface into transactions for the I3C interface, and vice-versa.
(FR) L'invention concerne un répéteur I3C. Le répéteur I3C peut comporter une première circuiterie avec une interface I3C, une deuxième circuiterie avec une interface I2C, et un circuit de trajet de données accouplé à la première circuiterie et à la deuxième circuiterie. La deuxième circuiterie peut être utilisée pour convertir une transaction reçue sur l'interface I2C en une transaction pour l'interface I3C, et pour convertir une transaction reçue sur l'interface I3C en une transaction pour l'interface I2C. Le répéteur I3C peut également comporter de la circuiterie supplémentaire pouvant être utilisée pour convertir des transactions reçues sur une interface parmi une interface SPI, une interface UART, et une interface de bus Debug en des transactions pour l'interface I3C, et vice-versa.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)