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1. (WO2017172147) ÉGALISEUR À RÉTROACTION DE DÉCISION NON ÉCHANTILLONNÉE COMPRENANT UN RETARD DE BOUCLE CONFIGURABLE
Dernières données bibliographiques dont dispose le Bureau international    Formuler une observation

N° de publication :    WO/2017/172147    N° de la demande internationale :    PCT/US2017/019429
Date de publication : 05.10.2017 Date de dépôt international : 24.02.2017
CIB :
H04L 25/03 (2006.01)
Déposants : INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95054 (US)
Inventeurs : LIN, Charlie Changhong; (US).
MULJONO, Harry; (US)
Mandataire : PERDOK, Monique M., Reg. No. 42,989; (US).
MCCRACKIN, Ann M., Reg. No. 42,858; (US).
SCHEER, Bradley W., Reg. No. 47,059; (US).
GOULD, James R., Reg. No. 72,086; (US).
WOO, Justin N., Reg. No. 62,686; (US).
BEEKMAN, Marvin L., Reg. No. 38,377; (US).
ARORA, Suneel, Reg. No. 42,267; (US).
BLACK, David W., Reg. No. 42,331; (US).
BIANCHI, Timothy E., Reg. No. 39,610; (US)
Données relatives à la priorité :
15/084,876 30.03.2016 US
Titre (EN) UN-SAMPLED DECISION FEEDBACK EQUALIZER INCLUDING CONFIGURABLE LOOP DELAY
(FR) ÉGALISEUR À RÉTROACTION DE DÉCISION NON ÉCHANTILLONNÉE COMPRENANT UN RETARD DE BOUCLE CONFIGURABLE
Abrégé : front page image
(EN)Some embodiments include apparatus and methods using circuits to receive an input signal, generate an equalized signal, provide the equalized signal to a node, amplify the equalized signal, and generate digital input information from the equalized signal. A delay circuit, including delay elements, is provided to apply a time delay to the digital input information and generate digital output information. A selector in the delay circuit provides feedback information from an output node of one of the delay elements. An adjust circuit, including switches on circuit paths coupled to the node, is provided to control the switches based on the feedback information.
(FR)Certains modes de réalisation de l'invention concernent un appareil et des procédés utilisant des circuits pour recevoir un signal d'entrée, produire un signal égalisé, fournir le signal égalisé à un nœud, amplifier le signal égalisé, et produire des informations d'entrée numériques à partir du signal égalisé. Un circuit de retard, contenant des éléments de retard, est utilisé pour appliquer un retard temporel aux informations d'entrée numériques et produire des informations de sortie numériques. Un sélecteur dans le circuit de retard fournit des informations de rétroaction à partir d'un nœud de sortie d'un des éléments de retard. Un circuit de réglage, contenant des commutateurs sur des trajets de circuit accouplés au nœud, est utilisé pour commander les commutateurs en fonction des informations de rétroaction.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)