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1. (WO2017053828) DISPOSITIF INFORMATIQUE À STRUCTURE DE TRAMES/CASES, COUCHE MENTOR ET TRAITEMENT D’OPÉRANDES MULTIPLES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2017/053828    N° de la demande internationale :    PCT/US2016/053486
Date de publication : 30.03.2017 Date de dépôt international : 23.09.2016
CIB :
G06F 17/50 (2006.01)
Déposants : POTASH, Hanan [US/US]; (US)
Inventeurs : POTASH, Hanan; (US)
Mandataire : THOMPSON, Chris D.; Meyertons, Hood, Kivlin, Kowert & Goetzel, P.C. Thompson, Chris D. P.O. Box 398 Austin, Texas 78767-0398 (US)
Données relatives à la priorité :
14/863,022 23.09.2015 US
14/863,032 23.09.2015 US
14/863,041 23.09.2015 US
14/863,047 23.09.2015 US
14/863,052 23.09.2015 US
Titre (EN) COMPUTING DEVICE WITH FRAMES/BINS STRUCTURE, MENTOR LAYER AND PLURAL OPERAND PROCESSING
(FR) DISPOSITIF INFORMATIQUE À STRUCTURE DE TRAMES/CASES, COUCHE MENTOR ET TRAITEMENT D’OPÉRANDES MULTIPLES
Abrégé : front page image
(EN)A computing device with multi-layer control: mentor layer and instruction/control layer includes a memory and one or more functional units. The computing device is configured to implement a multi-layer control structure including a data structure layer including a local high speed memory, a mentor layer, and an instruction/control layer. The local high speed memory includes one or more variables. The mentor layer includes one or more mentor circuits. The mentor circuits control actions associated with the Variables in the local high speed memory. The instruction/control layer includes one or more control circuits that interpret instructions or control operations by one or more functional units. In some embodiments, the local high speed memory implements a frame/bins structure. In some embodiments plural information is included in HLL and/or machine language.
(FR)L’invention concerne un dispositif informatique doté d’une commande multi-couche : une couche mentor et une couche d’instruction/commande comprend une mémoire et une ou plusieurs unités fonctionnelles. Le dispositif informatique est conçu pour mettre en œuvre une structure de commande multi-couche comprenant une couche de structure de données comprenant une mémoire locale rapide, une couche mentor et une couche d’instruction/commande. La mémoire locale rapide contient une ou plusieurs variables. La couche mentor contient un ou plusieurs circuits mentors. Les circuits mentors commandent les actions associées aux variables de la mémoire locale rapide. La couche d’instruction/commande contient un ou plusieurs circuits de commande qui interprètent des instructions ou commandent les opérations effectuées par une ou plusieurs unités fonctionnelles. Dans certains modes de réalisation, la mémoire local rapide met en œuvre une structure trame/cases. Dans certains modes de réalisation, différentes informations sont renfermées dans un langage de haut niveau et/ou un langage machine.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)