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1. (WO2017045351) REGISTRE À DÉCALAGE ET SON PROCÉDÉ DE COMMANDE, CIRCUIT DE COMMANDE DE GRILLE ET DISPOSITIF D'AFFICHAGE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2017/045351    N° de la demande internationale :    PCT/CN2016/073841
Date de publication : 23.03.2017 Date de dépôt international : 16.02.2016
CIB :
G09G 3/20 (2006.01)
Déposants : BOE TECHNOLOGY GROUP CO., LTD. [CN/CN]; No.10 Jiuxianqiao Rd., Chaoyang District Beijing 100015 (CN).
BEIJING BOE DISPLAY TECHNOLOGY CO., LTD. [CN/CN]; No. 118 Jinghaiyilu, BDA Beijing 100176 (CN)
Inventeurs : WANG, Zheng; (CN)
Mandataire : TEE&HOWE INTELLECTUAL PROPERTY ATTORNEYS; CHEN, Yuan 10th Floor, Tower D, Minsheng Financial Center, 28 Jianguomennei Avenue, Dongcheng District Beijing 100005 (CN)
Données relatives à la priorité :
201510596058.1 17.09.2015 CN
Titre (EN) SHIFT REGISTER AND DRIVING METHOD THEREFOR, GATE DRIVING CIRCUIT, AND DISPLAY DEVICE
(FR) REGISTRE À DÉCALAGE ET SON PROCÉDÉ DE COMMANDE, CIRCUIT DE COMMANDE DE GRILLE ET DISPOSITIF D'AFFICHAGE
(ZH) 移位寄存器及其驱动方法、栅极驱动电路和显示装置
Abrégé : front page image
(EN)A shift register and driving method therefor, a gate driving circuit, and a display device can solve the problems of large delay and high power consumption of the shift register of an existing gate driving circuit. The shift register comprises: an input module for guiding a signal at the output end (Output (N-1)) of a previous-stage shift register to a pull-up node (PU); an output module for guiding, according to the level of the pull-up node (PU), a signal at a first clock signal end (CLK) to an output end (Output N); a reset module for resetting, under the control of a signal at the output end (Output (N+1)) of a next-stage shift register, the pull-up node (PU), the output end (Output N), a first pull-down node (PD1), and a second pull-down node (PD2) by using signals at a turn-off signal end (Vss), a first signal end (Vdd1), and a second signal end (Vdd2); a voltage fixing module for guiding, according to the level of the pull-up node (PU), the signal at the turn-off signal end (Vss) to the two pull-down nodes (PD1, PD2); and a holding module for guiding, under the control of a second clock signal end (CLKB), the signals at the first signal end (Vdd1) and the second signal end (Vdd2) to the two pull-down nodes (PD1, PD2) respectively.
(FR)L'invention concerne un registre à décalage et son procédé de commande, un circuit de commande de grille et un dispositif d'affichage qui peuvent résoudre les problèmes de retard important et de grande consommation d'énergie du registre à décalage d'un circuit de commande de grille existant. Le registre à décalage comprend : un module d'entrée servant à guider un signal à l'extrémité de sortie (Sortie (N-1)) d'un registre à décalage d'étage précédent jusqu'à un nœud de rappel vers le niveau haut (PU) ; un module de sortie permettant de guider, selon le niveau du nœud de rappel vers le niveau haut (PU), un signal à une première extrémité de signal d'horloge (CLK) jusqu'à une extrémité de sortie (Sortie N) ; un module de remise à zéro destiné à remettre à zéro, sous le contrôle d'un signal à l'extrémité de sortie (Sortie (N+1)) d'un registre à décalage d'étage suivant, le nœud de rappel vers le niveau haut (PU), l'extrémité de sortie (Sortie N), un premier nœud de rappel vers le niveau bas (PD1) et un second nœud de rappel vers le niveau bas (PD2) au moyen de signaux à une extrémité de signal de coupure (Vss), une première extrémité de signal (Vdd1) et une seconde extrémité de signal (Vdd2) ; un module de fixation de tension conçu pour guider, selon le niveau du nœud de rappel vers le niveau haut (PU), le signal à l'extrémité de signal de coupure (Vss) jusqu'aux deux nœuds de rappel vers le niveau bas (PD1, PD2) ; et un module de maintien prévu pour guider, sous le contrôle d'une seconde extrémité de signal d'horloge (CLKB), les signaux à la première extrémité de signal (Vdd1) et à la seconde extrémité de signal (Vdd2) jusqu'aux deux nœuds de rappel vers le niveau bas (PD1, PD2), respectivement.
(ZH)一种移位寄存器及其驱动方法、栅极驱动电路和显示装置,其可解决现有栅极驱动电路移位寄存器中延迟和功耗大的问题。移位寄存器包括:输入模块,将上一级移位寄存器输出端(Output(N-1))信号引入上拉节点(PU);输出模块,根据上拉节点(PU)电平,将第一时钟信号端(CLK)信号引入输出端(Output N);重置模块,在下一级移位寄存器的输出端(Output(N+1))信号的控制下,用关断信号端(Vss)、第一信号端(Vdd1)、和第二信号端(Vdd2)信号重置上拉节点(PU)、输出端(Output N)、第一下拉节点(PD1)和第二下拉节点(PD2);定压模块,根据上拉节点(PU)电平,将关断信号端(Vss)信号引入两个下拉节点(PD1、PD2);保持模块,用于在第二时钟信号端(CLKB)控制下,将第一信号端(Vdd1)和第二信号端(Vdd2)信号分别引入两个下拉节点(PD1、PD2)。
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : chinois (ZH)
Langue de dépôt : chinois (ZH)