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1. (WO2017041441) SUBSTRAT MATRICIEL, SON PROCÉDÉ DE FABRICATION, ET DISPOSITIF D’AFFICHAGE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2017/041441    N° de la demande internationale :    PCT/CN2016/074046
Date de publication : 16.03.2017 Date de dépôt international : 18.02.2016
CIB :
G02F 1/1362 (2006.01)
Déposants : BOE TECHNOLOGY GROUP CO., LTD. [CN/CN]; No.10 Jiuxianqiao Rd., Chaoyang District Beijing 100015 (CN)
Inventeurs : LI, Wenbo; (CN).
WU, Yanbing; (CN)
Mandataire : LIU, SHEN & ASSOCIATES; 10th Floor, Building 1, 10 Caihefang Road, Haidian District Beijing 100080 (CN)
Données relatives à la priorité :
201510572156.1 09.09.2015 CN
Titre (EN) ARRAY SUBSTRATE, MANUFACTURING METHOD THEREFOR, AND DISPLAY DEVICE
(FR) SUBSTRAT MATRICIEL, SON PROCÉDÉ DE FABRICATION, ET DISPOSITIF D’AFFICHAGE
(ZH) 阵列基板及其制造方法、显示装置
Abrégé : front page image
(EN)An array substrate, a manufacturing method therefor, and a display device. The array substrate comprises multiple pixel units, where at least one of the pixel units comprises a first subpixel electrode (100) and a second subpixel electrode (200), the first subpixel electrode (100) is electrically connected to a first charging thin-film transistor (110), and the second subpixel electrode (200) is electrically connected to a second charging thin-film transistor (210). In same one pixel unit, the charging capacity of the second charging thin-film transistor (210) is greater than the charging capacity of the first charging thin-film transistor (110). The array substrate, the manufacturing method therefor, and the display device increases viewing angle characteristics of a liquid crystal display device.
(FR)L'invention concerne un substrat matriciel, son procédé de fabrication, et un dispositif d’affichage. Le substrat matriciel comprend de multiples unités de pixels, au moins l'une des unités de pixel comprenant une première électrode de sous-pixel (100) et une seconde électrode de sous-pixel (200), la première électrode de sous-pixel (100) étant électriquement connectée à un premier transistor de charge en couches minces (110), et la seconde électrode de sous-pixel (200) étant électriquement connectée à un second transistor de charge en couches minces (210). Dans une même unité de pixel, la capacité de charge du second transistor de charge en couches minces (210) est supérieure à la capacité de charge du premier transistor de charge en couches minces (110). Le substrat matriciel, son procédé de fabrication, et le dispositif d'affichage augmentent les caractéristiques d'angle de visualisation d'un dispositif d'affichage à cristaux liquides.
(ZH)一种阵列基板及其制造方法、显示装置。所述阵列基板包括多个像素单元,其中至少一个所述像素单元包括第一子像素电极(100)和第二子像素电极(200),所述第一子像素电极(100)电连接有第一充电薄膜晶体管(110),所述第二子像素电极(200)电连接有第二充电薄膜晶体管(210);在同一个所述像素单元中,所述第二充电薄膜晶体管(210)的充电能力比所述第一充电薄膜晶体管(110)的充电能力更强。上述阵列基板及其制造方法、显示装置能够提高液晶显示装置的视角特性。
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : chinois (ZH)
Langue de dépôt : chinois (ZH)