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1. (WO2016210014) GESTION DE BANDE PASSANTE DE MÉMOIRE POUR DES APPLICATIONS D'APPRENTISSAGE PROFOND
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2016/210014    N° de la demande internationale :    PCT/US2016/038836
Date de publication : 29.12.2016 Date de dépôt international : 23.06.2016
Demande présentée en vertu du Chapitre 2 :    23.11.2016    
CIB :
G06N 3/04 (2006.01), G06N 3/063 (2006.01), G06F 9/38 (2006.01), G10L 25/30 (2013.01)
Déposants : MICROSOFT TECHNOLOGY LICENSING, LLC [US/US]; Attn: Patent Group Docketing (Bldg. 8/1000) One Microsoft Way Redmond, Washington 98052-6399 (US)
Inventeurs : BITTNER, Ray A., Jr.; (US).
SEIDE, Frank Torsten Bernd; (US)
Mandataire : MINHAS, Sandip; (US).
FISCHER, Michael; Olswang Germany LLP Rosental 4 80331 Munich (DE)
Données relatives à la priorité :
14/750,277 25.06.2015 US
Titre (EN) MEMORY BANDWIDTH MANAGEMENT FOR DEEP LEARNING APPLICATIONS
(FR) GESTION DE BANDE PASSANTE DE MÉMOIRE POUR DES APPLICATIONS D'APPRENTISSAGE PROFOND
Abrégé : front page image
(EN)In a data center, neural network evaluations can be included for services involving image or speech recognition by using a field programmable gate array (FPGA) or other parallel processor. The memory bandwidth limitations of providing weighted data sets from an external memory to the FPGA (or other parallel processor) can be managed by queuing up input data from the plurality of cores executing the services at the FPGA (or other parallel processor) in batches of at least two feature vectors. The at least two feature vectors can be at least two observation vectors from a same data stream or from different data streams. The FPGA (or other parallel processor) can then act on the batch of data for each loading of the weighted datasets.
(FR)Selon l'invention, dans un centre de données, des évaluations de réseau neuronal peuvent être incluses pour des services impliquant une reconnaissance d'image ou de parole par utilisation d'une matrice prédiffusée programmable par l'utilisateur (FPGA) ou d'un autre processeur parallèle. Les limitations de bande passante de mémoire de fourniture d'ensemble de données pondérées d'une mémoire externe à la FPGA (ou un autre processeur parallèle) peuvent être gérées par mise en file d'attente de données d'entrée provenant de la pluralité de cœurs exécutant les services au niveau de la FPGA (ou un autre processeur parallèle) dans des lots d'au moins deux vecteurs de caractéristiques. Les au moins deux vecteurs de caractéristiques peuvent être au moins deux vecteurs d'observation provenant d'un même flux de données ou provenant de différents flux de données. La FPGA (ou un autre processeur parallèle) peut ensuite agir sur le lot de données pour chaque chargement des ensembles de données pondérées.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)