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1. (WO2016196378) ECC SUR PUCE AVEC COMPTEUR D'ERREURS ET GÉNÉRATION D'ADRESSES INTERNE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication : WO/2016/196378 N° de la demande internationale : PCT/US2016/034849
Date de publication : 08.12.2016 Date de dépôt international : 27.05.2016
CIB :
G06F 11/10 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
11
Détection d'erreurs; Correction d'erreurs; Contrôle de fonctionnement
07
Réaction à l'apparition d'un défaut, p.ex. tolérance de certains défauts
08
Détection ou correction d'erreur par introduction de redondance dans la représentation des données, p.ex. en utilisant des codes de contrôle
10
en ajoutant des chiffres binaires ou des symboles particuliers aux données exprimées suivant un code, p.ex. contrôle de parité, exclusion des 9 ou des 11
Déposants :
INTEL CORPORATION [US/US]; 2200 Mission College Blvd Santa Clara, CA 95054, US
Inventeurs :
HALBERT, John, B.; US
BAINS, Kuljit, S.; US
Mandataire :
ANDERSON, Vincent; US
Données relatives à la priorité :
14/865,95625.09.2015US
62/168,82831.05.2015US
Titre (EN) ON-DIE ECC WITH ERROR COUNTER AND INTERNAL ADDRESS GENERATION
(FR) ECC SUR PUCE AVEC COMPTEUR D'ERREURS ET GÉNÉRATION D'ADRESSES INTERNE
Abrégé :
(EN) A memory subsystem enables managing error correction information. A memory device internally performs error detection for a range of memory locations, and increments an internal count for each error detected. The memory device includes ECC logic to generate an error result indicating a difference between the internal count and a baseline number of errors preset for the memory device. The memory device can provide the error result to an associated host of the system to expose only a number of errors accumulated without exposing internal errors from prior to incorporation into a system. The memory device can be made capable to generate internal addresses to execute commands received from the memory controller. The memory device can be made capable to reset the counter after a first pass through the memory area in which errors are counted.
(FR) L'invention concerne un sous-système de mémoire permettant la gestion d'informations de correction d'erreurs. Un dispositif de mémoire exécute de façon interne une détection d'erreurs pour une plage d'emplacements de mémoire et incrémente un comptage interne pour chaque erreur détectée. Le dispositif de mémoire comprend une logique ECC pour la génération d'un résultat d'erreurs indiquant une différence entre le comptage interne et un nombre d'erreurs de base prédéfini pour le dispositif de mémoire. Le dispositif de mémoire peut fournir le résultat d'erreur à un hôte associé du système de manière à ne faire apparaître qu'un certain nombre d'erreurs accumulées sans faire apparaître des erreurs internes survenues avant l'incorporation dans un système. Le dispositif de mémoire peut être rendu apte à générer des adresses internes afin d'exécuter des commandes reçues depuis le contrôleur de mémoire. Le dispositif de mémoire peut être rendu apte à réinitialiser le compteur après un premier passage sur l'ensemble de la zone de mémoire dans laquelle des erreurs sont comptées.
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États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
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Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)