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1. (WO2016194655) DISPOSITIF ET PROCÉDÉ DE TRAITEMENT DE SIGNAL
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2016/194655    N° de la demande internationale :    PCT/JP2016/065025
Date de publication : 08.12.2016 Date de dépôt international : 20.05.2016
CIB :
G06F 1/14 (2006.01), G04G 5/00 (2013.01), G04G 7/00 (2006.01), G04G 99/00 (2010.01)
Déposants : SONY SEMICONDUCTOR SOLUTIONS CORPORATION [JP/JP]; 4-14-1, Asahi-cho, Atsugi-shi, Kanagawa 2430014 (JP)
Inventeurs : OHARA Sotaro; (JP).
TANAKA Katsuyuki; (JP).
TAKAOKA Katsumi; (JP).
IZUMI Keita; (JP).
HOUCHI Suguru; (JP).
HIDAI Gaku; (JP).
TAKAGI Yutaka; (JP).
TAKAHASHI Hideki; (JP).
AWATA Hideki; (JP).
KATAYAMA Yasushi; (JP).
YOSHIMOCHI Naoki; (JP).
SHIMIZU Toshimasa; (JP)
Mandataire : NISHIKAWA Takashi; (JP)
Données relatives à la priorité :
2015-114911 05.06.2015 JP
Titre (EN) SIGNAL PROCESSING DEVICE AND METHOD
(FR) DISPOSITIF ET PROCÉDÉ DE TRAITEMENT DE SIGNAL
(JA) 信号処理装置および方法
Abrégé : front page image
(EN)The present disclosure pertains to a signal processing device and method with which the required power can be reduced. In this signal processing device a real-time clock (RTC) of a main chip and a RTC of a power supply chip are synchronized before the power to the main chip is stopped, and after the power to the main chip is restored, the RTC of the main chip is again synchronized with the time of the RTC of the power supply chip. Thus, the RTCs are able to handle continuous time information before and after the power is stopped. The present disclosure can be applied to a GPS module in which multiple chips are used to form a digital circuit unit.
(FR)La présente invention concerne un dispositif et un procédé de traitement de signal permettant la réduction de puissance. Dans ce dispositif de traitement de signal une horloge temps réel (RTC) d'une puce principale et une horloge temps réel d'une puce d'alimentation électrique sont synchronisées avant l'interruption de la puissance à la puce principale, et après la restauration de l'alimentation électrique à la puce principale, l'horloge RTC de la puce principale est de nouveau synchronisée avec l'heure de l'horloge temps réel de la puce d'alimentation électrique. Ainsi, les horloges RTC sont capables de gérer une information temporelle continue avant et après l'interruption de l'alimentation électrique. La présente invention peut être appliquée à un module GPS dans lequel de multiples puces sont utilisées pour former une unité de circuit numérique.
(JA)本開示は、必要な電力を削減することができるようにする信号処理装置および方法に関する。 信号処理装置において、メインチップの電源停止前に、メインチップのRTCと電源チップのRTCとを同期しておき、メインチップの電源復帰後に電源チップのRTCの時刻に、再度メインチップのRTCを同期させる。このようにすることで、RTCは、停止前後で連続した時刻情報を扱うことができる。本開示は、例えば、複数のチップでデジタル回路部を構成するようにしたGPSモジュールに適用することができる。
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)