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1. (WO2016118158) SYSTÈME ET PROCÉDÉ D'AMÉLIORATION D'EFFICACITÉ DE TEST DE PRESSION
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2016/118158    N° de la demande internationale :    PCT/US2015/012712
Date de publication : 28.07.2016 Date de dépôt international : 23.01.2015
CIB :
G01M 99/00 (2011.01)
Déposants : INNOVATIVE PRESSURE TESTING, LLC [US/US]; 4710 Old Pecan Trail Fulshear, TX 77441 (US)
Inventeurs : FRANKLIN, Charles, M.; (US).
CULLY, Richard, A.; (US)
Mandataire : MOSCICKI, Matthew, R.; (US)
Données relatives à la priorité :
Titre (EN) SYSTEM AND METHOD FOR IMPROVING PRESSURE TEST EFFICIENCY
(FR) SYSTÈME ET PROCÉDÉ D'AMÉLIORATION D'EFFICACITÉ DE TEST DE PRESSION
Abrégé : front page image
(EN)A system includes a memory and a processor coupled to the memory. The processor receives a description of a pressure system, including a plurality of components to be tested, where each component has a required test pressure. The processor generates a first test sequence that tests the required test pressure of each of the plurality of components, where the first test sequence includes a first number of steps. The processor also iteratively generates a second test sequence that tests the required test pressure of each of the plurality of components, where the second test sequence comprises a second number of steps. The processor stores a representation of at least one of the first test sequence and the second test sequence in the memory, and the second number of steps is less than the first number of steps.
(FR)L'invention concerne un système comprenant une mémoire et un processeur couplé à la mémoire. Le processeur reçoit une description d'un système de pression, comprenant une pluralité de composants devant être testés, chaque composant présentant une pression test requise. Le processeur génère une première séquence de test qui teste la pression test requise de chacun des composants de la pluralité de composants, la première séquence de test comprenant un premier nombre d'étapes. Le processeur génère également de façon itérative une seconde séquence de test qui teste la pression test requise de chacun des composants de la pluralité de composants, la seconde séquence de test comprenant un second nombre d'étapes. Le processeur stocke une représentation d'au moins une première séquence de test parmi la première séquence de test et la seconde séquence de test dans la mémoire, et le second nombre d'étapes est inférieur au premier nombre d'étapes.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)