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1. (WO2016008129) COMPENSATION DE RÉPONSE EN FRÉQUENCE DANS UN CONVERTISSEUR NUMÉRIQUE-ANALOGIQUE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2016/008129    N° de la demande internationale :    PCT/CN2014/082387
Date de publication : 21.01.2016 Date de dépôt international : 17.07.2014
CIB :
H03M 1/66 (2006.01)
Déposants : LATTICE SEMICONDUCTOR CORPORATION [US/US]; 111 SW 5th Avenue, Suite 700 Portland, Oregon 97204 (US)
Inventeurs : ZHU, Jiabing; (US).
FU, Yibin; (US)
Mandataire : SHANGHAI PATENT & TRADEMARK LAW OFFICE, LLC; 435 Guiping Road Shanghai 200233 (CN)
Données relatives à la priorité :
Titre (EN) FREQUENCY RESPONSE COMPENSATION IN DIGITAL TO ANALOG CONVERTER
(FR) COMPENSATION DE RÉPONSE EN FRÉQUENCE DANS UN CONVERTISSEUR NUMÉRIQUE-ANALOGIQUE
Abrégé : front page image
(EN)A digital-analog converter (DAC) comprises a receiving circuit (310) configured to receive an input bit stream and generate a first bit signal stream of the input bit stream, a first delay circuit (320) coupled to the receiving circuit (310) to receive the first bit signal stream and to generate a second bit signal stream representing a delayed version of the first bit signal stream. The DAC also comprises a first current generation circuit (330) to receive the first bit signal stream, the first current generation circuit (330) configured to provide first current, corresponding to the first bit signal stream, to a first output. The DAC further comprises a second current generation circuit (340) to receive the second bit signal stream and to provide second current to the first output responsive to receiving the second bit signal stream, a waveform of the second current inverted and scaled relative to a waveform of the first current.
(FR)L'invention concerne un convertisseur numérique-analogique (CNA) qui comprend un circuit de réception (310) configuré pour recevoir un flux binaire d'entrée et générer un premier flux de signal binaire du flux binaire d'entrée, et un premier circuit à retard (320) couplé au circuit de réception (310) pour recevoir le premier flux de signal binaire et pour générer un second flux de signal binaire représentant une version retardée du premier flux de signal binaire. Le CNA comprend également un premier circuit de génération de courant (330) pour recevoir le premier flux de signal binaire, le premier circuit de génération de courant (330) étant configuré pour fournir un premier courant, correspondant au premier flux de signal binaire, à une première sortie. Le CNA comprend en outre un second circuit de génération de courant (340) pour recevoir le second flux de signal binaire et pour fournir second courant à la première sortie en réponse à la réception du second flux de signal binaire, la forme d'onde du second courant étant changée de signe et mise à l'échelle par rapport à la forme d'onde du premier courant.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)