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1. (WO2015177786) CONVERTISSEUR ANALOGIQUE-NUMÉRIQUE À LIGNE DE RETARD COMPLÈTEMENT SYNTHÉTISABLE COMPLÈTEMENT NUMÉRIQUE
Dernières données bibliographiques dont dispose le Bureau international

N° de publication : WO/2015/177786 N° de la demande internationale : PCT/IL2015/050521
Date de publication : 26.11.2015 Date de dépôt international : 17.05.2015
CIB :
H03M 1/82 (2006.01) ,H03M 1/50 (2006.01)
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
M
CODAGE, DÉCODAGE OU CONVERSION DE CODE, EN GÉNÉRAL
1
Conversion analogique/numérique; Conversion numérique/analogique
66
Convertisseurs numériques/analogiques
82
avec conversion intermédiaire en intervalle de temps
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
M
CODAGE, DÉCODAGE OU CONVERSION DE CODE, EN GÉNÉRAL
1
Conversion analogique/numérique; Conversion numérique/analogique
12
Convertisseurs analogiques/numériques
50
avec conversion intermédiaire en intervalle de temps
Déposants :
B.G. NEGEV TECHNOLOGIES AND APPLICATIONS LTD., AT BEN-GURION UNIVERSITY [IL/IL]; P.O.B. 653 8410501 Beer Sheva, IL
Inventeurs :
PERETZ, Mor Mordechai; IL
BEZDENEZHNYKH, Yevgeny; IL
Mandataire :
LUZZATTO, Kfir; IL
Données relatives à la priorité :
61/994,89818.05.2014US
Titre (EN) FULLY-DIGITAL FULLY-SYNTHESIZABLE DELAY-LINE ANALOG TO DIGITAL CONVERTER
(FR) CONVERTISSEUR ANALOGIQUE-NUMÉRIQUE À LIGNE DE RETARD COMPLÈTEMENT SYNTHÉTISABLE COMPLÈTEMENT NUMÉRIQUE
Abrégé :
(EN) The present invention relates to the realization of an ADC by using a one shot time cell as an analog-to-time converter and a time -to- digital converter. The present invention relates in general, to the design and Integrated Circuit (IC) implementation of a fully-digital fully-synthesizable, delay-line analog-to- digital converter (DL-ADC). The present invention is specifically relevant for power management applications where the silicon area of the controller is of key importance. The design of the ADC is based on the approach of delay cells string to reduce design complexity and the resultant of the silicon area.
(FR) La présente invention porte sur la réalisation d’un CAN en utilisant une cellule de temps court comme convertisseur analogique-temps et un convertisseur temps-numérique. La présente invention porte, en général, sur la conception et la réalisation d’un circuit intégré (CI) d’un convertisseur analogique-numérique à ligne de retard (CAN DL) complètement synthétisable complètement numérique. La présente invention est spécifiquement adaptée aux applications de gestion de puissance quand l’aire de silicium du système de commande représente une importance clé. La conception du CAN est basée sur l’approche de chaînes de cellules de retard pour réduire la complexité de conception et la résultante de l’aire de silicium.
front page image
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)
Also published as:
IL249021EP3146633US20170123381