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1. (WO2015116096) NŒUDS DE CALCUL MULTIPLES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2015/116096    N° de la demande internationale :    PCT/US2014/013816
Date de publication : 06.08.2015 Date de dépôt international : 30.01.2014
CIB :
G06F 13/14 (2006.01), G06F 13/40 (2006.01), G06F 11/16 (2006.01)
Déposants : HEWLETT PACKARD ENTERPRISE DEVELOPMENT LP [US/US]; 11445 Compaq Center Drive West Houston, TX 77070 (US)
Inventeurs : KADRI, Rachid; (US)
Mandataire : JAKOBSEN, Kraig; Hewlett Packard Enterprise 3404 E. Harmony Road Mail Stop 79 Fort Collins, CO 80528 (US)
Données relatives à la priorité :
Titre (EN) MULTIPLE COMPUTE NODES
(FR) NŒUDS DE CALCUL MULTIPLES
Abrégé : front page image
(EN)An example apparatus comprises a first compute node including a first processor; a second compute node including a second processor; an input/output (I/O) interface to selectively couple the first and second compute nodes to a set of I/O resources; and a voltage regulator including a set of power phase circuits, the voltage regulator to operate in a fault tolerant mode to provide power from selected ones of a first portion of the set of power phase circuits to the first compute node and to provide power from selected ones of a second portion of the set of power phase circuits to the second compute node.
(FR)La présente invention concerne un appareil donné à titre d'exemple qui comprend un premier nœud de calcul comprenant un premier processeur; un second nœud de calcul comprenant un second processeur; une interface entrée/sortie (E/S) permettant de coupler de manière sélective les premier et second nœuds de calcul à un ensemble de ressources E/S; et un régulateur de tension comprenant un ensemble de circuits de phase de puissance, le régulateur de tension fonctionnant dans un mode insensible aux défaillances afin de fournir de l'énergie à partir de parties sélectionnées parmi une première partie de l'ensemble de circuits de phase de puissance pour le premier nœud de calcul et de fournir de l'énergie à partir de parties sélectionnées parmi une seconde partie de l'ensemble de circuits de phase de puissance au second nœud de calcul.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)