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1. (WO2015099962) APPAREILS, MÉMOIRES ET PROCÉDÉS DE DÉCODAGE D'ADRESSE ET DE SÉLECTION D'UNE LIGNE D’ACCÈS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2015/099962    N° de la demande internationale :    PCT/US2014/068090
Date de publication : 02.07.2015 Date de dépôt international : 02.12.2014
CIB :
G11C 8/10 (2006.01), G11C 8/14 (2006.01)
Déposants : MICRON TECHNOLOGY, INC. [US/US]; 8000 South Federal Way Mail Stop 1-525 Boise, Idaho 83716-9632 (US)
Inventeurs : TANG, Stephen H.; (US)
Mandataire : DORSEY & WHITNEY LLP; 701 5TH Ave Suite 6100 Seattle, Washington 98104 (US)
Données relatives à la priorité :
14/139,493 23.12.2013 US
Titre (EN) APPARATUSES, MEMORIES, AND METHODS FOR ADDRESS DECODING AND SELECTING AN ACCESS LINE
(FR) APPAREILS, MÉMOIRES ET PROCÉDÉS DE DÉCODAGE D'ADRESSE ET DE SÉLECTION D'UNE LIGNE D’ACCÈS
Abrégé : front page image
(EN)Apparatuses, memories, and methods for decoding memory addresses for selecting access lines in a memory are disclosed. An example apparatus includes an address decoder circuit coupled to first and second select lines, a polarity line, and an access line. The first select line is configured to provide a first voltage, the second select line is configured to provide a second voltage, and the polarity line is configured to provide a polarity signal. The address decoder circuit is configured to receive address information and further configured to couple the access line to the first select line responsive to the address information having a combination of logic levels and the polarity signal having a first logic level and further configured to couple the access line to the second select line responsive to the address information having the combination of logic levels and the polarity signal having a second logic level.
(FR)L'invention concerne des appareils, des mémoires et des procédés pour décoder des adresses de mémoire pour sélectionner des lignes d'accès dans une mémoire. Un appareil à titre d'exemple comprend un circuit de décodeur d'adresse couplé à des première et seconde lignes de sélection, à une ligne de polarité et à une ligne d'accès. La première ligne de sélection est configurée pour fournir une première tension, la seconde ligne de sélection est configurée pour fournir une seconde tension, et la ligne de polarité est configurée pour fournir un signal de polarité. Le circuit de décodeur d'adresse est configuré pour recevoir des informations d'adresse et en outre configuré pour coupler la ligne d'accès à la première ligne de sélection en réponse au fait que les informations d'adresse ont une combinaison de niveaux logiques et que le signal de polarité a un premier niveau logique, et en outre configuré pour coupler la ligne d'accès à la seconde ligne de sélection en réponse au fait que les informations d'adresse ont la combinaison de niveaux logiques et que le signal de polarité a un second niveau logique.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)