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1. (WO2014094050) CIRCUIT RÉCEPTEUR
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/094050    N° de la demande internationale :    PCT/AU2013/001483
Date de publication : 26.06.2014 Date de dépôt international : 18.12.2013
CIB :
H04B 1/16 (2006.01)
Déposants : THE UNIVERSITY OF MELBOURNE [AU/AU]; Grattan Street University of Melbourne, Victoria 3010 (AU)
Inventeurs : EVANS, Robin J; (AU).
SKAFIDAS, Efstratios; (AU).
DUONG, Hoa Thai; (AU).
LE, Viet Hoang; (AU).
LI, John; (AU)
Mandataire : GRIFFITH HACK; GPO Box 1285 Melbourne, Victoria 3001 (AU)
Données relatives à la priorité :
2012905586 20.12.2012 AU
Titre (EN) A RECEIVER CIRCUIT
(FR) CIRCUIT RÉCEPTEUR
Abrégé : front page image
(EN)A receiver circuit comprising first and second antennas; an input amplification stage comprising first and second input amplifier circuits for amplifying first and second signals received at the first and second antennas respectively; a switching stage comprising first and second transconductance components connected respectively to the first and second input amplifier circuits and to a common output, and a switching mechanism arranged to selectively turn on and off the first and second transconductance components so that only one of the first and second transconductance components is in an on state at any time, the first and second transconductance components further amplifying the first and second signals respectively when in an on state; and an output amplification stage connected to the common output of the switching stage and comprising an output amplifier circuit for further amplifying the first and second signals when they are outputted via the common output.
(FR)La présente invention concerne un circuit récepteur qui comprend : des première et seconde antennes ; un étage d'amplification d'entrée comprenant des premier et second circuits amplificateurs d'entrée servant à amplifier des premier et second signaux reçus respectivement par les première et seconde antennes ; un étage de commutation comprenant des premier et second composants de transconductance connectés respectivement aux premier et second circuits amplificateurs d'entrée et à une sortie commune, et un mécanisme de commutation agencé pour activer et désactiver sélectivement les premier et second composants de transconductance de sorte qu'un seul des premier et second composants de transconductance soit dans un état actif à tout moment, les premier et second composants de transconductance amplifiant en outre respectivement les premier et second signaux lorsqu'ils sont dans l'état actif ; et un étage d'amplification de sortie connecté à la sortie commune de l'étage de commutation et comprenant un circuit amplificateur de sortie servant à amplifier davantage les premier et second signaux lorsqu'ils sont délivrés en sortie par la sortie commune.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)