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1. (WO2014088721) DÉTECTEUR DE DÉCALAGE DE PHASE D'HORLOGE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/088721    N° de la demande internationale :    PCT/US2013/066528
Date de publication : 12.06.2014 Date de dépôt international : 24.10.2013
CIB :
H03K 5/19 (2006.01)
Déposants : INTERNATIONAL BUSINESS MACHINES CORPORATION [US/US]; New Orchard Road Armonk, NY 10504 (US)
Inventeurs : FENG, Kai, D.; (US).
GUO, Jong-Ru; (US).
SHAH, Trushil, N.; (US).
WANG, Ping-Chuan; (US).
YANG, Zhijian; (US)
Mandataire : MACKINNON, Ian, D.; IBM Corporation 2070 Route 52 Bldg. 321/ZIP 482 Hopewell Junction, NY 12533 (US)
Données relatives à la priorité :
13/707,748 07.12.2012 US
Titre (EN) CLOCK PHASE SHIFT DETECTOR
(FR) DÉTECTEUR DE DÉCALAGE DE PHASE D'HORLOGE
Abrégé : front page image
(EN)A clock phase shift detector circuit 100 may include a phase detector 102 for generating a phase signal (Z) based on a phase difference between first (I) and second (Q) clock signals. A current mirror 104 having a first (C1, a second (C2), and a third (C3) integrator may be coupled to the phase detector 102, whereby the first integrator integrates the first clock signal and generates a first voltage, the second integrator integrates the first clock signal and generates a second voltage, and the third integrator integrates the phase signal and generates a third voltage. A first comparator 106 receives the first and the third voltage, and generates a first control signal. A second comparator 108 receives the second and the third voltage, and generates a second control signal. The first and second control signals may detect a change between the phase difference of the first and the second clock signal and an optimized phase difference.
(FR)L'invention concerne un circuit de détecteur de décalage de phase d'horloge (100) comprenant un détecteur de phase (102) afin de générer un signal de phase (Z) en fonction d'une différence de phase entre un premier (I) et un second (Q) signal d'horloge. Un miroir de courant (104) comprenant un premier (C1), un second (C2) et un troisième (C3) intégrateurs peut être couplé au détecteur de phase (102), le premier intégrateur intégrant le premier signal d'horloge et générant une première tension, le second intégrateur intégrant le premier signal d'horloge et générant une seconde tension, et le troisième intégrateur intégrant le signal de phase et générant une troisième tension. Un premier comparateur (106) reçoit les première et troisième tensions, et génère un premier signal de commande. Un second comparateur (108) reçoit les seconde et troisième tensions, et génère un second signal de commande. Les premier et second signaux de commande peuvent détecter un changement entre la différence de phase des premier et second signaux d'horloge et une différence de phase optimisée.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)