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1. (WO2014088223) CIRCUIT AMPLIFICATEUR ET SON PROCÉDÉ D'UTILISATION
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/088223    N° de la demande internationale :    PCT/KR2013/010130
Date de publication : 12.06.2014 Date de dépôt international : 08.11.2013
CIB :
H03F 1/07 (2006.01), H03F 3/60 (2006.01)
Déposants : SAMSUNG ELECTRONICS CO., LTD. [KR/KR]; 129, Samsung-ro, Yeongtong-gu Suwon-si Gyeonggi-do 443-742 (KR)
Inventeurs : KIKUCHI, Hiroyoshi; (JP).
UEDA, Kazuhiro; (JP)
Mandataire : LEE, Keon-Joo; Mihwa Bldg. 110-2, Myongryun-dong 4-ga Chongro-gu Seoul 110-524 (KR)
Données relatives à la priorité :
2012-268706 07.12.2012 JP
10-2013-0131264 31.10.2013 KR
Titre (EN) AMPLIFIER CIRCUIT AND OPERATION METHOD THEREOF
(FR) CIRCUIT AMPLIFICATEUR ET SON PROCÉDÉ D'UTILISATION
Abrégé : front page image
(EN)Disclosed is an amplifier circuit capable of achieving high efficiency at back off power while maintaining high output power when an amplifier of a driving stage is saturated in a multistage amplifier in which a plurality of amplifiers are connected in series to each other. In the amplifier circuit, at least two amplifiers including a first amplifier and a second amplifier, the first amplifier preceding the second the first amplifier, are connected in series to each other, the second amplifier changes input impedance according to output power from the first amplifier, and an impedance adjusting unit for adjusting output load impedance of the first amplifier is disposed between the first amplifier and the second amplifier, wherein the impedance adjusting unit optimizes the output load impedance of the first amplifier according to a change of input impedance of the second amplifier.
(FR)L'invention concerne un circuit amplificateur permettant d'atteindre un rendement élevé lors de réduction de puissance tout en maintenant une puissance de sortie élevée lorsqu'un amplificateur d'une étape d'entraînement est saturé dans un amplificateur à plusieurs étages dans lequel une pluralité d'amplificateurs sont reliés en série les uns aux autres. Dans le circuit amplificateur, au moins deux amplificateurs comprenant un premier amplificateur et un second amplificateur, le premier amplificateur précédant le second amplificateur, sont reliés en série les uns aux autres, le second amplificateur modifie une impédance d'entrée selon la puissance de sortie du premier amplificateur, et une unité de réglage d'impédance pour le réglage d'impédance de charge de sortie du premier amplificateur est disposée entre le premier amplificateur et le second amplificateur, l'unité de réglage d'impédance optimisant l'impédance de charge de sortie du premier amplificateur selon un changement d'impédance d'entrée du second amplificateur.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, KE, KG, KN, KP, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)