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1. (WO2014085685) TRANSFERT DE DONNÉES ENTRE DES DOMAINES DE PUISSANCE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/085685    N° de la demande internationale :    PCT/US2013/072374
Date de publication : 05.06.2014 Date de dépôt international : 27.11.2013
Demande présentée en vertu du Chapitre 2 :    11.02.2015    
CIB :
G06F 17/50 (2006.01), G06F 1/32 (2006.01), H03K 19/00 (2006.01)
Déposants : QUALCOMM INCORPORATED [US/US]; Attn: International IP Administration 5775 Morehouse Drive San Diego, California 92121 (US)
Inventeurs : XIE, Jing; (US).
DU, Yang; (US)
Mandataire : PAULEY, Nicholas J.; 5775 Morehouse Drive San Diego, California 92121 (US)
Données relatives à la priorité :
61/730,767 28.11.2012 US
61/730,755 28.11.2012 US
13/792,486 11.03.2013 US
13/792,592 11.03.2013 US
Titre (EN) DATA TRANSFER ACROSS POWER DOMAINS
(FR) TRANSFERT DE DONNÉES ENTRE DES DOMAINES DE PUISSANCE
Abrégé : front page image
(EN)The disclosed embodiments comprise a multi-stage circuit (10) operating across different power domains (A, B). The multi-stage circuit may be implemented as a master-slave flip-flop circuit (10c) integrated with a level shifter (65c) that transfers data across different power domains. The master and slave stages of the flip-flop may be split across two tiers (102, 104) of a 3D IC and may include (i) a level shifter across different power domain integrated within the flip-flop circuit, (ii) reduced one-state writing delays by a self-induced power collapsing technique, (iii) splitting flip-flop power supplies in different tiers using monolithic 3D IC technology, and (iv) cross power domain data transfer between 3D IC tiers.
(FR)Les formes de réalisation de l'invention comprennent un circuit à plusieurs étages (10) fonctionnant entre des domaines de puissance (A, B) différents. Le circuit à plusieurs étages peut être mis en oeuvre en tant que circuit bistable maître-esclave (10c) intégré à un dispositif de décalage de niveau (65c), qui transfère des données entre différents domaines de puissance. Les étages maître et esclave du circuit bistable peuvent être partagés entre deux couches (102, 104) d'un circuit intégré 3D, et peuvent comprendre (i) un dispositif de décalage de niveau entre des domaines de puissance différents intégrés dans le circuit bistable; (ii) des temps réduits d'écriture d'un état, obtenus au moyen d'une technique de chute de puissance auto-induite; (iii) des alimentations bistables, réparties dans différentes couches au moyen d'une technologie de circuit intégré 3D monolithique; et (iv) le transfert de données entre des domaines de puissance, entre des couches de circuit intégré 3D.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)