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1. (WO2014062262) PROCÉDÉ PERMETTANT DE RÉDUIRE UNE GIGUE D'EXÉCUTION DANS DES PROCESSEURS À NOYAUX MULTIPLES À L'INTÉRIEUR D'UN SYSTÈME DE GESTION D'INFORMATIONS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/062262    N° de la demande internationale :    PCT/US2013/051979
Date de publication : 24.04.2014 Date de dépôt international : 25.07.2013
CIB :
G06F 1/00 (2006.01)
Déposants : DELL PRODUCTS, L.P. [--/US]; One Dell Way Round Rock, TX 78682 (US)
Inventeurs : MOLLY, Michael, Karl; (US).
KHATRI, Mukund, P.; (US).
HORMUTH, Robert, Wayne; (US)
Mandataire : ISIDORE, Eustace, P.; Isidore PLLC 8911 N. Capital Of Texas Hwy. Suite 2110 Austin, TX 78759 (US)
Données relatives à la priorité :
13/652,512 16.10.2012 US
Titre (EN) REDUCING EXECUTION JITTER IN MULTI-CORE PROCESSORS
(FR) PROCÉDÉ PERMETTANT DE RÉDUIRE UNE GIGUE D'EXÉCUTION DANS DES PROCESSEURS À NOYAUX MULTIPLES À L'INTÉRIEUR D'UN SYSTÈME DE GESTION D'INFORMATIONS
Abrégé : front page image
(EN)A method of reducing execution jitter includes a processor having several cores and control logic that receives core configuration parameters. Control logic determines if a first set of cores are selected to be disabled. If none of the cores is selected to be disabled, the control logic determines if a second set of cores is selected to be jitter controlled. If the second set of cores is selected to be jitter controlled, the second set of cores is set to a first operating state. If the first set of cores is selected to be disabled, the control logic determines a second operating state for a third set of enabled cores. The control logic determines if the third set of enabled cores is jitter controlled, and if the third set of enabled cores is jitter controlled, the control logic sets the third set of enabled cores to the second operating state.
(FR)L'invention concerne un procédé permettant de réduire une gigue d'exécution, qui comprend un processeur possédant plusieurs noyaux et une logique de commande qui reçoit des paramètres de configuration de noyaux. Une logique de commande détermine si un premier ensemble de noyaux est sélectionné pour être désactivé. Si aucun des noyaux n'est sélectionné pour être désactivé, la logique de commande détermine si un deuxième ensemble de noyaux est sélectionné pour être commandé par une gigue. Si le deuxième ensemble de noyaux est sélectionné pour être commandé par une gigue, le deuxième ensemble de noyaux est réglé sur un premier état de fonctionnement. Si le premier ensemble de noyaux est sélectionné pour être désactivé, la logique de commande détermine un second état de fonctionnement destiné à un troisième ensemble de noyaux activés. La logique de commande détermine si le troisième ensemble de noyaux activés est commandé par une gigue, et si le troisième ensemble de noyaux activés est commandé par une gigue, la logique de commande règle le troisième ensemble de noyaux activés sur le second état de fonctionnement.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)