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1. (WO2014030209) CIRCUIT INTÉGRÉ À SEMI-CONDUCTEURS ET PROCÉDÉ DE GÉNÉRATION D'IMPULSIONS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/030209    N° de la demande internationale :    PCT/JP2012/071060
Date de publication : 27.02.2014 Date de dépôt international : 21.08.2012
CIB :
H03K 5/00 (2006.01), H03K 5/04 (2006.01)
Déposants : FUJITSU LIMITED [JP/JP]; 1-1, Kamikodanaka 4-chome, Nakahara-ku, Kawasaki-shi, Kanagawa 2118588 (JP) (Tous Sauf US).
HOSHIMOTO, Akitaka [JP/JP]; (JP) (US Seulement).
TAKEDA, Hideo [JP/JP]; (JP) (US Seulement)
Inventeurs : HOSHIMOTO, Akitaka; (JP).
TAKEDA, Hideo; (JP)
Mandataire : KOKUBUN, Takayoshi; 5th Floor, NBF Ikebukuro City Building, 17-8, Higashi-Ikebukuro 1-chome, Toshima-ku, Tokyo 1700013 (JP)
Données relatives à la priorité :
Titre (EN) SEMICONDUCTOR INTEGRATED CIRCUIT AND PULSE GENERATION METHOD
(FR) CIRCUIT INTÉGRÉ À SEMI-CONDUCTEURS ET PROCÉDÉ DE GÉNÉRATION D'IMPULSIONS
(JA) 半導体集積回路及びパルス生成方法
Abrégé : front page image
(EN)A semiconductor integrated circuit quickly determines a pulse width based on transistor characteristics and capable of writing a latch circuit, in such a way that: a plurality of pulses having different pulse widths are generated by a plurality of chopper circuits; a plurality of operation confirmation latch circuits latch a changed input value by using the respective pulses; and a chopper circuit with a pulse width variable function changes the pulse width of a pulse for driving the latch circuit on the basis of the outputs of the operation confirmation latch circuits and generates and outputs the pulse having the changed pulse width.
(FR)L'invention concerne un circuit intégré à semi-conducteurs qui détermine rapidement une largeur d'impulsion sur la base de caractéristiques de transistor et qui peut procéder à une écriture dans un circuit à verrouillage de telle manière qu'une pluralité d'impulsions présentant différentes largeurs sont générées par une pluralité de circuits de découpeur ; une pluralité de circuits à verrouillage à confirmation d'opération verrouillent une valeur d'entrée modifiée à l'aide des impulsions respectives ; et un circuit de découpeur à fonction variable de largeur d'impulsion modifie la largeur d'une impulsion afin d'exciter le circuit à verrouillage sur la base des sorties des circuits à verrouillage à confirmation d'opération et génère et produit en sortie l'impulsion présentant la largeur modifiée.
(JA) 複数のチョッパー回路によりパルス幅の異なる複数のパルスを生成し、複数のパルスの各々のパルスで、変化した入力値を複数の動作確認用のラッチ回路がラッチし、パルス幅可変機能を有するチョッパー回路が、動作確認用のラッチ回路の出力に基づいてラッチ回路を駆動するパルスのパルス幅を変更し、そのパルス幅のパルスを生成して出力するようにし、トランジスタ特性に応じた、ラッチ回路に書き込みを行えるパルス幅を速やかに決定する。
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)