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1. (WO2014009689) COMMANDE D'ORDRE DE TRAITEMENT D'ÉLÉMENTS DE DONNÉES DURANT UN TRAITEMENT VECTORIEL
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/009689    N° de la demande internationale :    PCT/GB2013/051530
Date de publication : 16.01.2014 Date de dépôt international : 11.06.2013
CIB :
G06F 9/30 (2006.01), G06F 9/38 (2006.01), G06F 9/45 (2006.01)
Déposants : ARM LIMITED [--/GB]; 110 Fulbourn Road Cherry Hinton Cambridge CB1 9NJ (GB)
Inventeurs : REID, Alastair David; (GB)
Mandataire : MILLS, Julia; D Young & Co LLP 120 Holborn London EC1N 2DY (GB)
Données relatives à la priorité :
13/546,227 11.07.2012 US
Titre (EN) CONTROLLING AN ORDER FOR PROCESSING DATA ELEMENTS DURING VECTOR PROCESSING
(FR) COMMANDE D'ORDRE DE TRAITEMENT D'ÉLÉMENTS DE DONNÉES DURANT UN TRAITEMENT VECTORIEL
Abrégé : front page image
(EN)A data processing apparatus for processing a stream of vector instructions for performing operations on vectors, said vectors each comprising a plurality of data elements is disclosed. The data processing apparatus comprises: a register bank having a plurality of registers for storing the vectors being processed; a pipelined processor for processing the stream of vector instructions; the pipelined processor comprising circuitry configured to detect data dependencies for the vectors processed by the stream of vector instructions and stored in the plurality of registers and to determine constraints on timing of execution for the vector instructions such that no register data hazards arise, said register data hazards arising where two accesses to a same register, at least one of said accesses being a write, occur in an order different to an order of said instruction stream such that an access occurring later in said instruction stream starts before an access occurring earlier in said instruction stream has completed. The pipelined processor comprises data element hazard determination circuitry configured to determine for at least some of the data elements within vectors where data dependencies have been identified, whether the data dependencies identified for the vectors exist for each of the at least some of the data elements, and if not to relax the determined constraints on timing of execution for an instruction processing the data element.
(FR)L'invention porte sur un appareil de traitement de données destiné à traiter un flux d'instructions vectorielles pour effectuer des opérations sur des vecteurs, lesdits vecteurs comprenant chacun une pluralité d'éléments de données. L'appareil de traitement de données comprend : un banc de registres comprenant une pluralité de registres pour stocker les vecteurs qui sont traités; et un processeur pipeline pour traiter le flux d'instructions vectorielles, le processeur pipeline comprenant une circuiterie configurée pour détecter des dépendances de données pour les vecteurs traités par le flux d'instructions vectorielles et stockés dans la pluralité de registres et pour déterminer des contraintes sur un instant d'exécution pour les instructions vectorielles de manière qu'aucun risque de données de registre n'apparaisse, lesdits risques de données de registre apparaissant lorsque deux accès à un même registre, au moins un desdits accès étant une écriture, surviennent dans un ordre différent d'un ordre dudit flux d'instructions de sorte qu'un accès survenant plus tard dans ledit flux d'instructions commence avant achèvement d'un accès survenant plus tôt dans ledit flux d'instructions. Le processeur pipeline comprend une circuiterie de détermination de risque d'élément de données configurée pour déterminer, pour au moins certains des éléments de données dans des vecteurs dans lesquels des dépendances de données ont été identifiées, si les dépendances de données identifiées pour les vecteurs existent pour chacun desdits au moins certains éléments de données; et si tel n'est pas le cas, pour relâcher les contraintes déterminées sur l'instant d'exécution pour une instruction traitant l'élément de données.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)