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1. (WO2014008001) OSCILLATEUR COMMANDÉ EN TENSION À DEUX CIRCUITS DE RETARD À LARGE PLAGE DE FRÉQUENCES D'ACCORD
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/008001    N° de la demande internationale :    PCT/US2013/046921
Date de publication : 09.01.2014 Date de dépôt international : 20.06.2013
CIB :
H03K 3/03 (2006.01)
Déposants : QUALCOMM INCORPORATED [US/US]; Attn: International IP Administration 5775 Morehouse Drive San Diego, California 92121-1714 (US)
Inventeurs : TERROVITIS, Emmanouil; (US).
KOMIJANI, Abbas; (US)
Mandataire : PARADICE III, William L.; Mahamedi Paradice Kreisman LLP 550 South Winchester Blvd., Suite 605 San Jose, California 95128 (US)
Données relatives à la priorité :
61/667,082 02.07.2012 US
13/651,340 12.10.2012 US
Titre (EN) A TWO-DELAY VOLTAGE-CONTROLLED-OSCILLATOR WITH WIDE TUNING RANGE
(FR) OSCILLATEUR COMMANDÉ EN TENSION À DEUX CIRCUITS DE RETARD À LARGE PLAGE DE FRÉQUENCES D'ACCORD
Abrégé : front page image
(EN)An oscillator is disclosed that can generate an oscillation signal using a latch and two delay elements. For some embodiments, the oscillator includes an SR latch, a first delay element, and a second delay element. The SR latch has a first input, a second input, a first output, and a second output. The first delay element is coupled between the first output and the first input of the SR latch. The second delay element is coupled between the second output and the second input of the SR latch. For some embodiments, the first and second delay elements include a programmable pull-up circuit that allows the charging current to be adjusted in discrete amounts, and include a programmable capacitor circuit that allows the capacitance value to be adjusted in discrete amounts.
(FR)La présente invention concerne un oscillateur qui peut générer un signal d'oscillation utilisant un verrou et deux circuits de retard. Dans certains modes de réalisation, l'oscillateur comprend un verrou SR, un premier circuit de retard et un second circuit de retard. Le verrou SR comporte une première entrée, une seconde entrée, une première sortie et une seconde sortie. Le premier circuit de retard est couplé entre la première sortie et la première entrée du verrou SR. Le second circuit de retard est couplé entre la seconde sortie et la seconde entrée du verrou SR. Dans certains modes de réalisation, les premier et second circuits de retard comprennent un circuit d'excursion haute programmable qui permet que le courant de charge soit ajusté en quantités discrètes, et comprennent un circuit de condensateur programmable qui permet que la valeur de capacitance soit ajustée en quantités discrètes.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)