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1. (WO2013192448) GESTION DE L'UTILISATION D'UN RÉSEAU DE PORTES PROGRAMMABLE PAR L'UTILISATEUR AVEC DES COMPOSANTS ISOLÉS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2013/192448    N° de la demande internationale :    PCT/US2013/046881
Date de publication : 27.12.2013 Date de dépôt international : 20.06.2013
CIB :
G06F 21/44 (2013.01), G06F 21/76 (2013.01), G06F 21/85 (2013.01)
Déposants : MICROSOFT CORPORATION [US/US]; One Microsoft Way Redmond, Washington 98052-6399 (US)
Inventeurs : LAMACCHIA, Brian; (US).
NIGHTINGALE, Edmund B.; (US).
BARHAM, Paul; (US)
Données relatives à la priorité :
13/528,400 20.06.2012 US
Titre (EN) MANAGING USE OF A FIELD PROGRAMMABLE GATE ARRAY WITH ISOLATED COMPONENTS
(FR) GESTION DE L'UTILISATION D'UN RÉSEAU DE PORTES PROGRAMMABLE PAR L'UTILISATEUR AVEC DES COMPOSANTS ISOLÉS
Abrégé : front page image
(EN)Field programmable gate arrays can be used as a shared programmable co-processor resource in a general purpose computing system. Components of an FPGA are isolated to protect the FPGA and data transferred between the FPGA and other components of the computer system. For example, data written by the FPGA to memory is encrypted, and is decrypted within the FPGA when read back from memory. Data transferred between the FPGA and other components such as the CPU or GPU, whether directly or through memory, can similarly be encrypted using cryptographic keys known to the communicating components. Transferred data also can be digitally signed by the FPGA or other component to provide authentication. Code for programming the FPGA can be encrypted and signed by the author, loaded into the FPGA in an encrypted state, and then decrypted and authenticated by the FPGA itself, before programming the FPGA with the code.
(FR)Il est possible d'utiliser des réseaux de portes programmables par l'utilisateur en tant que ressource de coprocesseur programmable partagé dans un système informatique d'usage universel. Des composants d'un FPGA sont isolés de façon à protéger le FPGA et les données transférés entre le FPGA et d'autres composants du système informatique. Par exemple, des données écrites par le FPGA vers la mémoire sont chiffrées et sont déchiffrées à l'intérieur du FPGA quand elles sont lues en provenance de la mémoire. Les données transférées entre le FPGA et d'autres composants tels que la CPU ou une GPU, que ce soit de manière directe ou par l'intermédiaire de la mémoire, peuvent de la même façon être chiffrées en utilisant des clés de chiffrement connues des composants de communication. Les données transférées peuvent également être signées de manière numérique par le FPGA ou par tout autre composant de façon à fournir une authentification. Le code destiné à programmer le FPGA peut être chiffré et signé par l'auteur, chargé dans le FPGA dans un état chiffré et ensuite déchiffré et authentifié par le FPGA lui-même, avant de programmer le FPGA avec le code.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)