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1. WO2013132567 - CIRCUIT D'ÉCHANTILLONNAGE, CONVERTISSEUR A/N, CONVERTISSEUR N/A ET CODEC

Numéro de publication WO/2013/132567
Date de publication 12.09.2013
N° de la demande internationale PCT/JP2012/008402
Date du dépôt international 27.12.2012
CIB
H03M 1/08 2006.1
HÉLECTRICITÉ
03CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
MCODAGE, DÉCODAGE OU CONVERSION DE CODE, EN GÉNÉRAL
1Conversion analogique/numérique; Conversion numérique/analogique
06Compensation ou prévention continue de l'influence indésirable de paramètres physiques
08du bruit
G11C 27/02 2006.1
GPHYSIQUE
11ENREGISTREMENT DE L'INFORMATION
CMÉMOIRES STATIQUES
27Mémoires analogiques électriques, p.ex. pour emmagasiner des valeurs instantanées
02Moyens d'échantillonnage et de mémorisation
H03M 1/12 2006.1
HÉLECTRICITÉ
03CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
MCODAGE, DÉCODAGE OU CONVERSION DE CODE, EN GÉNÉRAL
1Conversion analogique/numérique; Conversion numérique/analogique
12Convertisseurs analogiques/numériques
H03M 1/66 2006.1
HÉLECTRICITÉ
03CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
MCODAGE, DÉCODAGE OU CONVERSION DE CODE, EN GÉNÉRAL
1Conversion analogique/numérique; Conversion numérique/analogique
66Convertisseurs numériques/analogiques
CPC
G11C 27/02
GPHYSICS
11INFORMATION STORAGE
CSTATIC STORES
27Electric analogue stores, e.g. for storing instantaneous values
02Sample-and-hold arrangements
G11C 27/024
GPHYSICS
11INFORMATION STORAGE
CSTATIC STORES
27Electric analogue stores, e.g. for storing instantaneous values
02Sample-and-hold arrangements
024using a capacitive memory element
G11C 27/026
GPHYSICS
11INFORMATION STORAGE
CSTATIC STORES
27Electric analogue stores, e.g. for storing instantaneous values
02Sample-and-hold arrangements
024using a capacitive memory element
026associated with an amplifier
G11C 7/02
GPHYSICS
11INFORMATION STORAGE
CSTATIC STORES
7Arrangements for writing information into, or reading information out from, a digital store
02with means for avoiding parasitic signals
G11C 7/16
GPHYSICS
11INFORMATION STORAGE
CSTATIC STORES
7Arrangements for writing information into, or reading information out from, a digital store
16Storage of analogue signals in digital stores using an arrangement comprising analogue/digital [A/D] converters, digital memories and digital/analogue [D/A] converters 
H03M 1/0656
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
MCODING; DECODING; CODE CONVERSION IN GENERAL
1Analogue/digital conversion; Digital/analogue conversion
06Continuously compensating for, or preventing, undesired influence of physical parameters
0617characterised by the use of methods or means not specific to a particular type of detrimental influence
0634by averaging out the errors, e.g. using sliding scale
0656in the time domain, e.g. using intended jitter as a dither signal
Déposants
  • 旭化成エレクトロニクス株式会社 ASAHI KASEI MICRODEVICES CORPORATION [JP]/[JP]
Inventeurs
  • 中西 純弥 NAKANISHI, Junya
  • 中西 豊 NAKANISHI, Yutaka
Mandataires
  • 森 哲也 MORI, Tetsuya
Données relatives à la priorité
2012-05096307.03.2012JP
2012-11060914.05.2012JP
2012-13103408.06.2012JP
Langue de publication Japonais (ja)
Langue de dépôt japonais (JA)
États désignés
Titre
(EN) SAMPLING CIRCUIT, A/D CONVERTER, D/A CONVERTER, CODEC
(FR) CIRCUIT D'ÉCHANTILLONNAGE, CONVERTISSEUR A/N, CONVERTISSEUR N/A ET CODEC
(JA) サンプリング回路、A/D変換器、D/A変換器、CODEC
Abrégé
(EN) A sampling circuit (150) is made up of a continuous unit (150a) which is a circuit that transmits a continuous signal, a digital unit that transmits a sampled and quantized signal, and a sample holding unit (150b) that is provided between the continuous unit (150a) and the digital unit and transmits a signal that has been sampled but has not been quantized. The sample holding unit (150b) includes capacitors (111_1, 111_2) that accumulate charge generated by an input signal, and a plurality of switches (101_1, 101_2, 102_1, 102_2) for accumulating charge in each of the capacitors, and the plurality of switches receive supply of a plurality of clock signals (φS3, φS4) having mutually different operation timings, and perform ON and OFF operations in accordance with the supplied clock signals.
(FR) L'invention porte sur un circuit d'échantillonnage (150) qui est constitué d'une unité continue (150a) qui est un circuit qui émet un signal continu, d'une unité numérique qui émet un signal échantillonné et quantifié, et d'une unité de maintien d'échantillon (150b) qui est placée entre l'unité continue (150a) et l'unité numérique et émet un signal qui a été échantillonné mais n'a pas été quantifié. L'unité de maintien d'échantillon (150b) comprend des condensateurs (111_1, 111_2) qui accumulent une charge générée par un signal d'entrée, et une pluralité d'interrupteurs (101_1, 101_2, 102_1, 102_2) pour accumuler une charge dans chacun des condensateurs, et la pluralité d'interrupteurs reçoivent une pluralité de signaux d'horloge (φS3, φS4) fournis ayant des instants d'actionnement mutuellement différents, et effectuent des opérations de fermeture et d'ouverture conformément aux signaux d'horloge fournis.
(JA)  連続的な信号を伝達する回路であるコンテニアス部(150a)、標本化及び量子化がされた信号を伝達するデジタル部、コンテニアス部(150a)とデジタル部との間にあって、標本化され、かつ量子化されていない信号を伝達するサンプル・ホールド部(150b)によってサンプリング回路(150)を構成する。そして、サンプル・ホールド部(150b)は、入力信号によって生じる電荷を蓄積するキャパシタ(111_1、111_2)、各キャパシタにそれぞれ電荷を蓄積するための複数のスイッチ(101_1、101_2、102_1、102_2)と、を含み、複数のスイッチは、動作タイミングが互いに異なる複数のクロック信号(φS3、φS4)の供給を受け、供給されたクロック信号にしたがってオン、オフ動作をする。
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