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1. (WO2013064072) PROCÉDÉ ET APPAREIL POUR EFFECTUER DES RECHERCHES DANS DES TABLES DE RÉSEAU
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2013/064072    N° de la demande internationale :    PCT/CN2012/083849
Date de publication : 10.05.2013 Date de dépôt international : 31.10.2012
CIB :
G11C 5/06 (2006.01)
Déposants : HUAWEI TECHNOLOGIES CO., LTD. [CN/CN]; Huawei Administration Building, Bantian, Longgang Shenzhen, Guangdong 518129 (CN)
Inventeurs : SONG, Haoyu; (US).
WANG, Xinyuan; (CN).
CAO, Wei; (US)
Données relatives à la priorité :
13/285,728 31.10.2011 US
Titre (EN) A METHOD AND APPARATUS FOR NETWORK TABLE LOOKUPS
(FR) PROCÉDÉ ET APPAREIL POUR EFFECTUER DES RECHERCHES DANS DES TABLES DE RÉSEAU
Abrégé : front page image
(EN)An apparatus comprising a plurality of memory components each comprising a plurality of memory banks, a memory controller coupled to the memory components and configured to control and select a one of the plurality of memory components for a memory operation, a plurality of address/command buses coupled to the plurality of memory components and the memory controller comprising at least one shared address/command bus between at least some of the plurality of memory components, and a plurality of data buses coupled to the memory components and the memory controller comprising at least one data bus between at least some of the memory components, wherein the memory controller uses a memory interleaving and bank arbitration scheme in a time-division multiplexing (TDM) fashion to access the plurality of memory components and the memory banks.
(FR)La présente invention concerne un appareil qui comprend une pluralité de composants de mémoire comprenant chacun une pluralité de banques de mémoire, un contrôleur de mémoire couplé aux composants de mémoire et configuré pour commander et sélectionner un composant de la pluralité de composants de mémoire en vue d'une opération de mémoire, une pluralité de bus d'adresses/commandes couplés à la pluralité de composants de mémoire et au contrôleur de mémoire et comprenant au moins un bus d'adresses/commandes partagé entre au moins certains composants de la pluralité de composants de mémoire, et une pluralité de bus de données couplés aux composants de mémoire et au contrôleur de mémoire et comprenant au moins un bus de données entre au moins certains des composants de mémoire. Le contrôleur de mémoire utilise un système d'entrelacement de mémoires et d'arbitrage de banques à la manière d'un multiplexage par répartition dans le temps (MRT) pour accéder à la pluralité de composants de mémoire et aux banques de mémoire.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)