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1. (WO2013057856) ÉGALISEUR ADAPTATIF
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2013/057856    N° de la demande internationale :    PCT/JP2012/004252
Date de publication : 25.04.2013 Date de dépôt international : 29.06.2012
CIB :
G06F 17/14 (2006.01), H04B 7/005 (2006.01), H04J 11/00 (2006.01)
Déposants : PANASONIC CORPORATION [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501 (JP) (Tous Sauf US).
YOMO, Hidekuni; (US Seulement).
MATSUOKA, Akihiko; (US Seulement).
MARUYAMA, Atsushi; (US Seulement)
Inventeurs : YOMO, Hidekuni; .
MATSUOKA, Akihiko; .
MARUYAMA, Atsushi;
Mandataire : WASHIDA, Kimihito; 8th Floor, Shinjuku First West Bldg., 1-23-7, Nishi-Shinjuku, Shinjuku-ku, Tokyo 1600023 (JP)
Données relatives à la priorité :
2011-227922 17.10.2011 JP
Titre (EN) ADAPTIVE EQUALIZER
(FR) ÉGALISEUR ADAPTATIF
(JA) 適応等化器
Abrégé : front page image
(EN)An adaptive equalizer capable of suppressing an increase in circuit scale and an increase in operation clock frequency. An adaptive equalizer (100) performs an adaptive equalization process on a time-region signal in a frequency region. A signal converter (200) has: a first wide-bit memory (201) capable of reading/writing a plurality of sample signals; a first register group (202) comprising a plurality of registers capable of accessing the first wide-bit memory (201); a butterfly computation unit group (204) comprising a plurality of butterfly computation units; and a first connection switching unit (203) for switching the state of connection between the plurality of registers and the plurality of butterfly computation units.
(FR)L'invention concerne un égaliseur adaptatif capable de supprimer une augmentation de l'échelle du circuit et une augmentation de la fréquence d'horloge de fonctionnement. Un égaliseur adaptatif (100) exécute un processus d'égalisation adaptative sur un signal de zone temporelle dans une zone de fréquence. Un convertisseur de signaux (200) comprend : une première mémoire binaire large (201) capable de lire/écrire une pluralité de signaux d'échantillons; un premier groupe de registres (202) comprenant une pluralité de registres capables d'accéder à la première mémoire binaire large (201); un groupe d'unités de calcul papillon (204) comprenant une pluralité d'unités de calcul papillon; et une première unité de commutation de connexion (203) permettant de commuter l'état de connexion entre la pluralité de registres et la pluralité d'unités de calcul papillon.
(JA) 回路規模の増大および動作クロック周波数の増加を抑えることができる適応等化器。適応等化器(100)は、時間領域の信号に対する適応等化処理を周波数領域で行う適応等化器である。信号変換部(200)は、複数サンプル分の信号を読み書きすることができる第1のワイドビットメモリ(201)と、これら第1のワイドビットメモリ(201)にアクセス可能な複数のレジスタから成る第1のレジスタ群(202)と、複数のバタフライ演算部から成るバタフライ演算部群(204)と、複数のレジスタと複数のバタフライ演算部との間の接続状態を切り替える第1の接続切替部(203)とを有する。
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)