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1. WO2012005949 - APPAREIL, PROCÉDÉ ET SYSTÈME POUR AMÉLIORER LE RENDEMENT PERFORMANCES/PUISSANCE PAR COUPLAGE D'UN PREMIER TYPE DE CŒUR À UN SECOND TYPE DE CŒUR

Numéro de publication WO/2012/005949
Date de publication 12.01.2012
N° de la demande internationale PCT/US2011/041429
Date du dépôt international 22.06.2011
CIB
G06F 9/46 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9Dispositions pour la commande par programme, p.ex. unités de commande
06utilisant des programmes stockés, c. à d. utilisant un moyen de stockage interne à l'équipement de traitement de données pour recevoir ou conserver les programmes
46Dispositions pour la multiprogrammation
G06F 9/38 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9Dispositions pour la commande par programme, p.ex. unités de commande
06utilisant des programmes stockés, c. à d. utilisant un moyen de stockage interne à l'équipement de traitement de données pour recevoir ou conserver les programmes
30Dispositions pour exécuter des instructions machines, p.ex. décodage d'instructions
38Exécution simultanée d'instructions
G06F 1/32 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
1Détails non couverts par les groupes G06F3/-G06F13/89
26Alimentation en énergie électrique, p.ex. régulation à cet effet
32Moyens destinés à économiser de l'énergie
CPC
G06F 9/30076
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
30003Arrangements for executing specific machine instructions
30076to perform miscellaneous control operations, e.g. NOP
G06F 9/30174
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
3017Runtime instruction translation, e.g. macros
30174for non-native instruction set, e.g. Javabyte, legacy code
G06F 9/3879
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
38Concurrent instruction execution, e.g. pipeline, look ahead
3877using a slave processor, e.g. coprocessor
3879for non-native instruction execution, e.g. executing a command; for Java instruction set
G06F 9/4893
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
46Multiprogramming arrangements
48Program initiating; Program switching, e.g. by interrupt
4806Task transfer initiation or dispatching
4843by program, e.g. task dispatcher, supervisor, operating system
4881Scheduling strategies for dispatcher, e.g. round robin, multi-level priority queues
4893taking into account power or heat criteria
Y02D 10/24
YSECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
02TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
DCLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THIR OWN ENERGY USE
10Energy efficient computing
20Reducing energy consumption by means of multiprocessor or multiprocessing based techniques, other than acting upon the power supply
24Scheduling
Déposants
  • INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95052, US (AllExceptUS)
  • WU, Youfeng [US/US]; US (UsOnly)
  • HU, Shiliang [CN/US]; US (UsOnly)
  • BORIN, Edson [BR/US]; US (UsOnly)
  • WANG, Cheng, C. [CN/US]; US (UsOnly)
  • BRETERNITZ, Mauricio, Jr. [US/US]; US (UsOnly)
  • LIU, Wei [CN/US]; US (UsOnly)
Inventeurs
  • WU, Youfeng; US
  • HU, Shiliang; US
  • BORIN, Edson; US
  • WANG, Cheng, C.; US
  • BRETERNITZ, Mauricio, Jr.; US
  • LIU, Wei; US
Mandataires
  • VINCENT, Lester J.; Blakely Sokoloff Taylor & Zafman 1279 Oakmead Parkway Sunnyvale, California 94085, US
Données relatives à la priorité
12/826,10729.06.2010US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) APPARATUS, METHOD, AND SYSTEM FOR IMPROVING POWER PERFORMANCE EFFICIENCY BY COUPLING A FIRST CORE TYPE WITH A SECOND CORE TYPE
(FR) APPAREIL, PROCÉDÉ ET SYSTÈME POUR AMÉLIORER LE RENDEMENT PERFORMANCES/PUISSANCE PAR COUPLAGE D'UN PREMIER TYPE DE CŒUR À UN SECOND TYPE DE CŒUR
Abrégé
(EN)
An apparatus and method is described herein for coupling a processor core of a first type with a co-designed core of a second type. Execution of program code on the first core is monitored and hot sections of the program code are identified. Those hot sections are optimize for execution on the co-designed core, such that upon subsequently encountering those hot sections, the optimized hot sections are executed on the co- designed core. When the co-designed core is executing optimized hot code, the first processor core may be in a low-power state to save power or executing other code in parallel. Furthermore, multiple threads of cold code may be pipelined on the first core, while multiple threads of hot code are pipeline on the co-designed core to achieve maximum performance.
(FR)
L'invention porte sur un appareil et un procédé de couplage d'un cœur de processeur d'un premier type à un cœur conçu en collaboration d'un second type. L'exécution d'un code de programme sur le premier cœur est surveillée et des sections chaudes du code de programme sont identifiées. Ces sections chaudes sont optimisées en vue d'une exécution sur le cœur conçu en collaboration, de telle manière que, lors d'une rencontre subséquente de ces sections chaudes, les sections chaudes optimisées soient exécutées sur le cœur conçu en collaboration. Lorsque le cœur conçu en collaboration est en train d'exécuter un code chaud optimisé, le premier cœur de processeur peut être dans un état basse puissance pour économiser l'énergie ou peut exécuter un autre code en parallèle. En outre, de multiples fils de code froid peuvent être mis en pipeline sur le premier cœur, tandis que de multiples fils de code chaud sont mis en pipeline sur le cœur conçu en collaboration pour atteindre des performances maximales.
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